參數(shù)資料
型號： UPSD3354DV-40T6T
廠商： 意法半導(dǎo)體
英文描述： Turbo Series Fast 8032 MCU with Programmable Logic
中文描述： Turbo系列8032微控制器的快速可編程邏輯
文件頁數(shù)： 190/231頁
文件大?。?/td> 3722K
代理商： UPSD3354DV-40T6T
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uPSD33xx
190/231
Forced Power Down (FDP).
An alternative to
APD is FPD. The resulting power-savings is the
same, but the PDN signal in
Figure 78., page 191
is set and Power-Down mode is entered immedi-
ately when firmware sets the FORCE_PD Bit to
logic '1' in the csiop Register PMMR3 (Bit 1). FPD
will
override
APD
counter
FORCE_PD is set. No external clock source for
the APD counter is needed. The FORCE_PD Bit is
cleared only by a reset condition.
Caution must be used when implementing FPD
because code memory goes off-line as soon as
PSD Module Power-Down mode is entered, leav-
ing the MCU with no instruction stream to execute.
activity
when
The MCU Module must put itself into Power-Down
mode after it puts the PSD Module into Power-
Down Mode. How can it do this if code memory
goes off-line The answer is the Pre-Fetch Queue
(PFQ) in the MCU Module. By using the instruction
scheme shown in the 8051 assembly code exam-
ple in Table
120
, the PFQ will be loaded with the
final instructions to command the MCU Module to
Power Down mode after the PDS Module goes to
Power-Down mode. In this case, even though the
code memory goes off-line in the PSD Module, the
last few MCU instruction are sourced from the
PFQ.
Table 120. Forced Power-Down Example
PDOWN:
ANL
A8h, #7Fh
; disable all interrupts
ORL
9Dh, #C0h
; ensure PFQ and BC are enabled
MOV
DPTR, #xxC7
; load XDATA pointer to select PMMR3 register (xx = base
; address of csiop registers)
CLR
A
; clear A
JMP
LOOP
; first loop - fill PFQ/BQ with Power Down instructions
NOP
; second loop - fetch code from PFQ/BC and set Power-
; Down bits for PSD Module and then MCU Module
LOOP:
MOVX
@DPTR, A
; set FORCE_PD Bit in PMMR3 in PSD Module in second
; loop
MOV
87h, A
; set PD Bit in PCON Register in MCU Module in second
; loop
MOV
A, #02h
; set power-down bit in the A Register, but not in PMMR3 or
; PCON yet in first loop
JMP
LOOP
; uPSD enters into Power-Down mode in second loop
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PDF描述
UPSD33XX Fast 8032 MCU with Programmable Logic
uPSD3412C-24U6T Flash Programmable System Devices with 8032 Microcontroller Core and 16Kbit SRAM
UPSD3422EV Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic(帶有USB和可編程邏輯的Turbo Plus系列快速Turbo 8032 MCU)
UPSD3434EV Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic(帶有USB和可編程邏輯的Turbo Plus系列快速Turbo 8032 MCU)
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