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參數(shù)資料
| 型號： | UPSD3253BV-40T6 |
| 廠商： | 意法半導(dǎo)體 |
| 元件分類： | DC/DC變換器 |
| 英文描述： | RP30 (E) Series - Powerline Regulated DC-DC Converters; Input Voltage (Vdc): 48V; Output Voltage (Vdc): 12V; 2:1 Wide Input Voltage Range; 30 Watts Output Power; 1.6kVDC Isolation; UL Certified; Fixed Operating Frequency; Six-Sided Continuous Shield; International Safety Standard Approvals; Standard 50.8 x40.6x10.2mm Package; Efficiency to 90% |
| 中文描述： | 閃存可編程系統(tǒng)設(shè)備與8032微控制器核心和256Kbit的SRAM |
| 文件頁數(shù)： | 165/176頁 |
| 文件大?。?/td> | 1214K |
| 代理商： | UPSD3253BV-40T6 |
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165/176
μPSD325X DEVICES
Figure 84. Peripheral I/O WRITE Timing
Table 133. Port A Peripheral Data Mode WRITE Timing (5V Devices)
Note: 1. Data stable on Port 0 pins to data on Port A.
Table 134. Port A Peripheral Data Mode WRITE Timing (3V Devices)
Note: 1. Data stable on Port 0 pins to data on Port A.
Symbol
Parameter
Conditions
Min
Max
Unit
t
WLQV–PA
WR to Data Propagation Delay
25
ns
t
DVQV–PA
Data to Port A Data Propagation Delay
(Note
1
)
22
ns
t
WHQZ–PA
WR Invalid to Port A Tri-state
20
ns
Symbol
Parameter
Conditions
Min
Max
Unit
t
WLQV–PA
WR to Data Propagation Delay
42
ns
t
DVQV–PA
Data to Port A Data Propagation Delay
(Note
1
)
38
ns
t
WHQZ–PA
WR Invalid to Port A Tri-state
33
ns
tDVQV (PA)
tWLQV (PA)
tWHQZ (PA)
ADDRESS
DATA OUT
A/D BUS
WR
PORT A
DATA OUT
ALE
AI06611
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PDF描述 |
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