參數資料
型號： UPD78F1167AGC-UEU-AX
廠商： Renesas Electronics America
文件頁數： 471/966頁
文件大?。?/td> 0K
描述： MCU 16BIT 78K0R/KX3 100-LQFP
標準包裝： 300
系列： 78K0R/Kx3
核心處理器： 78K/0R
芯體尺寸： 16-位
速度： 20MHz
連通性： 3 線 SIO，I²C，LIN，UART/USART
外圍設備： DMA，LVD，POR，PWM，WDT
輸入/輸出數： 83
程序存儲器容量： 384KB（384K x 8）
程序存儲器類型： 閃存
RAM 容量： 24K x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 5.5 V
數據轉換器： A/D 16x10b; D/A 2x8b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 100-LQFP
包裝： 托盤
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CHAPTER 13 SERIAL ARRAY UNIT
User’s Manual U17894EJ9V0UD
520
Table 13-4. Selection of Operation Clock
SMRmn
Register
SPSm Register
Operation Clock (MCK)
Note 1
CKSmn
PRS
m13
PRS
m12
PRS
m11
PRS
m10
PRS
m03
PRS
m02
PRS
m01
PRS
m00
fCLK = 20 MHz
X
0
fCLK
20 MHz
X
0
1
fCLK/2
10 MHz
X
0
1
0
fCLK/2
2
5 MHz
X
0
1
fCLK/2
3
2.5 MHz
X
0
1
0
fCLK/2
4
1.25 MHz
X
0
1
0
1
fCLK/2
5
625 kHz
X
0
1
0
fCLK/2
6
313 kHz
X
0
1
fCLK/2
7
156 kHz
X
1
0
fCLK/2
8
78.1 kHz
X
1
0
1
fCLK/2
9
39.1 kHz
X
1
0
1
0
fCLK/2
10
19.5 kHz
X
1
0
1
fCLK/2
11
9.77 kHz
0
X
1
INTTM02 if m = 0,
INTTM03 if m = 1
Note 2
0
X
fCLK
20 MHz
0
1
X
fCLK/2
10 MHz
0
1
0
X
fCLK/2
2
5 MHz
0
1
X
fCLK/2
3
2.5 MHz
0
1
0
X
fCLK/2
4
1.25 MHz
0
1
0
1
X
fCLK/2
5
625 kHz
0
1
0
X
fCLK/2
6
313 kHz
0
1
X
fCLK/2
7
156 kHz
1
0
X
fCLK/2
8
78.1 kHz
1
0
1
X
fCLK/2
9
39.1 kHz
1
0
1
0
X
fCLK/2
10
19.5 kHz
1
0
1
X
fCLK/2
11
9.77 kHz
1
X
INTTM02 if m = 0,
INTTM03 if m = 1
Note 2
Other than above
Setting prohibited
Notes 1. When changing the clock selected for fCLK (by changing the system clock control register (CKC)
value), do so after having stopped (STm = 000FH) the operation of the serial array unit (SAU).
When selecting INTTM02 and INTTM03 for the operation clock, also stop the timer array unit (TAU)
(TT0 = 00FFH).
2. SAU can be operated at a fixed division ratio of the subsystem clock, regardless of the fCLK
frequency (main system clock, subsystem clock), by operating the interval timer for which fSUB/4
has been selected as the count clock (setting TIS02 (if m = 0) or TIS03 (if m = 1) of the TIS0
register to 1) and selecting INTTM02 and INTTM03 by using the SPSm register in channels 2 and
3 of TAU. When changing fCLK, however, SAU and TAU must be stopped as described in Note 1
above.
Remarks 1. X: Don’t care
2.
m: Unit number (m = 0, 1), n: Channel number (n = 0, 2)
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