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參數(shù)資料
| 型號(hào)： | UPD75068GB |
| 廠商： | NEC Corp. |
| 英文描述： | 4-BIT SINGLE-CHIP MICROCOMPUTER |
| 中文描述： | 4位單片機(jī) |
| 文件頁(yè)數(shù)： | 47/68頁(yè) |
| 文件大?。?/td> | 640K |
| 代理商： | UPD75068GB |
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47
μ
PD75064, 75066, 75068, 75064(A), 75066(A), 75068(A)
t
SIK2
100
ns
Serial Transfer Operation
2-Wire and 3-Wire Serial I/O Modes (SCK ... Internal clock output)
Parameter
Symbol
Conditions
MIN.
TYP.
MAX.
Unit
SCK cycle time
V
DD
= 4.5 to 6.0 V
1600
ns
t
KCY1
3800
ns
SCK high- and low-
level width
V
DD
= 4.5 to 6.0 V
t
KCY1
/2-50
ns
t
KCY1
/2-150
ns
SI setup time
(to SCK
↑
)
SI hold time
(from SCK
↑
)
SO output
delay time
from SCK
↓
V
DD
= 4.5 to 6.0 V
0
250
ns
t
KSO1
0
1000
ns
2-Wire and 3-Wire Serial I/O Modes (SCK ... External clock input)
Parameter
Symbol
Conditions
MIN.
TYP.
MAX.
Unit
SCK cycle time
V
DD
= 4.5 to 6.0 V
800
ns
t
KCY2
3200
ns
SCK high- and low-
level width
V
DD
= 4.5 to 6.0 V
400
ns
1600
ns
SI setup time
(to SCK
↑
)
SI hold time
(from SCK
↑
)
SO output
delay time
from SCK
↓
V
DD
= 4.5 to 6.0 V
0
300
ns
t
KSO2
0
1000
ns
Note
R
L
and C
L
are load resistance and load capacitance of the SO output line, respectively.
t
SIK1
150
ns
t
KSI1
400
ns
t
KL1
t
KH1
R
L
= 1 k
,
C
L
= 100 pF
Note
t
KSI2
400
ns
t
KL2
t
KH2
R
L
= 1 k
,
C
L
= 100 pF
Note
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PDF描述 |
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