μPD720102 PCI Bus Interface : handles 32-bit 33 MHz PCI bus master and target" />
參數(shù)資料
型號： UPD720102GC-YEB-A
廠商： Renesas Electronics America
文件頁數(shù)： 34/38頁
文件大?。?/td> 0K
描述： IC HOST CTLR USB2.0 3-PORTS QFP
標(biāo)準(zhǔn)包裝： 100
控制器類型： USB 2.0 控制器
接口： PCI
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -20°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 120-TQFP
供應(yīng)商設(shè)備封裝： 120-TQFP（14x14）
包裝： 托盤
Data Sheet S17998EJ4V0DS
3
μPD720102
PCI Bus Interface
: handles 32-bit 33 MHz PCI bus master and target function which comply with PCI
specification revision 2.2. The number of enabled ports is set by bit in configuration
space.
Arbiter
: arbitrates among two OHCI host controller cores and one EHCI host controller core.
OHCI Host Controller
: handles full- (12 Mbps)/low-speed (1.5 Mbps) signaling.
EHCI Host Controller
: handles high- (480 Mbps) signaling.
Root Hub
: handles USB hub function in host controller and controls connection (routing) between
host controller core and port.
PHY
: consists of high-speed transceiver, full-/low-speed transceiver, serializer, deserializer,
etc.
INTA0
: is the PCI interrupt signal for OHCI Host Controller.
SMI0
: is the interrupt signal which is specified by open host controller interface specification
for USB release 1.0a and enhanced host controller interface specification revision 1.0.
The SMI signal of each OHCI host controller and EHCI host controller appears at this
signal.
PME0
: is the interrupt signal which is specified by PCI-bus power management interface
specification revision 1.1. Wakeup signal of each host controller core appears at this
signal.
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PDF描述
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