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參數(shù)資料
| 型號： | UPD44324362F5-E40-EQ2 |
| 廠商： | NEC Corp. |
| 元件分類： | DRAM |
| 英文描述： | 36M-BIT DDRII SRAM 2-WORD BURST OPERATION |
| 中文描述： | 36M條位SRAM的2條DDRII字爆發(fā)運(yùn)作 |
| 文件頁數(shù)： | 5/32頁 |
| 文件大小： | 349K |
| 代理商： | UPD44324362F5-E40-EQ2 |
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5
Preliminary Data Sheet
M16780EJ2V0DS
μ
PD44324082, 44324092, 44324182, 44324362
165-pin PLASTIC FBGA (13 x 15)
(Top View)
[
μ
PD44324182F5-EQ2]
1
2
3
4
5
6
7
8
9
10
11
A
/CQ
V
SS
A
R, /W
/BW1
/K
NC
/LD
A
A
CQ
B
NC
DQ9
NC
A
NC
K
/BW0
A
NC
NC
DQ8
C
NC
NC
NC
V
SS
A
A0
A
V
SS
NC
DQ7
NC
D
NC
NC
DQ10
V
SS
V
SS
V
SS
V
SS
V
SS
NC
NC
NC
E
NC
NC
DQ11
V
DD
Q
V
SS
V
SS
V
SS
V
DD
Q
NC
NC
DQ6
F
NC
DQ12
NC
V
DD
Q
V
DD
V
SS
V
DD
V
DD
Q
NC
NC
DQ5
G
NC
NC
DQ13
V
DD
Q
V
DD
V
SS
V
DD
V
DD
Q
NC
NC
NC
H
/DLL
V
REF
V
DD
Q
V
DD
Q
V
DD
V
SS
V
DD
V
DD
Q
V
DD
Q
V
REF
ZQ
J
NC
NC
NC
V
DD
Q
V
DD
V
SS
V
DD
V
DD
Q
NC
DQ4
NC
K
NC
NC
DQ14
V
DD
Q
V
DD
V
SS
V
DD
V
DD
Q
NC
NC
DQ3
L
NC
DQ15
NC
V
DD
Q
V
SS
V
SS
V
SS
V
DD
Q
NC
NC
DQ2
M
NC
NC
NC
V
SS
V
SS
V
SS
V
SS
V
SS
NC
DQ1
NC
N
NC
NC
DQ16
V
SS
A
A
A
V
SS
NC
NC
NC
P
NC
NC
DQ17
A
A
C
A
A
NC
NC
DQ0
R
TDO
TCK
A
A
A
/C
A
A
A
TMS
TDI
A0, A
DQ0 to DQ17
/LD
R, /W
/BW0, /BW1
K, /K
C, /C
CQ, /CQ
ZQ
/DLL
: Address inputs
: Data inputs / outputs
: Synchronous load
: Read Write input
: Byte Write data select
: Input clock
: Output clock
: Echo clock
: Output impedance matching
: DLL disable
TMS
TDI
TCK
TDO
V
REF
V
DD
V
DD
Q
V
SS
NC
: IEEE 1149.1 Test input
: IEEE 1149.1 Test input
: IEEE 1149.1 Clock input
: IEEE 1149.1 Test output
: HSTL input reference input
: Power Supply
: Power Supply
: Ground
: No connection
Remarks 1.
Refer to
Package Drawing
for the index mark.
2.
2A and 7A are expansion addresses: 2A for 72Mb and 7A for 144Mb.
3.
2A is internally unconnected.
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