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參數(shù)資料
| 型號： | UPD17072 |
| 廠商： | NEC Corp. |
| 英文描述： | 4-BIT SINGLE-CHIP MICROCONTROLLER WITH HARDWARE FOR DIGITAL TUNING SYSTEM |
| 中文描述： | 4位單芯片的數(shù)字調(diào)諧系統(tǒng)硬件單片機 |
| 文件頁數(shù)： | 191/226頁 |
| 文件大?。?/td> | 1250K |
| 代理商： | UPD17072 |
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μ
PD17072,17073
191
20.3.2 CE reset when clock stop mode (STOP s instruction) is used
Figure 22-3 shows the operation.
When the clock stop mode is used, the IRES, RES, and RESET signals are output at the point where the “STOP
s” instruction has been executed.
While the CE pin is low, output of the IRES signal continues; therefore, the forced halt status, which is released
by the basic timer 0 carry, is set.
However, the device stops operation because the clock is stopped. When the CE pin goes high, the clock stop
mode is released and oscillation is started.
At this time, the halt status that is released by the basic timer 0 carry FF is set by the IRES signal. After the CE
pin has risen, the oscillation stabilization status lasts (for 125 ms or longer). If the basic timer 0 carry FF setting pulse
rises after that, the halt status is released, and program execution is started from address 0.
Figure 20-3. CE Reset Operation When Clock Stop Mode Is Used
20.3.3 Notes on CE reset
Because CE reset is effected regardless of the instruction under execution, the following points (1) and (2) must
be noted.
(1) Time for executing timer processing such as watch
To create a watch program by using the basic timer 0 or basic timer 1, the processing of the program must
be completed within specific time.
For details, refer to
12.2.5 Notes on using basic timer 0
and
12.3.4 Notes on using basic timer 1
.
(2) Processing of data or flag used in program
Exercise care in rewriting data or flags that cannot be processed with one instruction and whose contents must
not be changed even if CE reset is effected, such as security code.
Here is an example:
Basic timer 0 carry
FF setting pulse
IRES
RES
RESET
Halt status
125 ms
or more
V
DD
CE
X
OUT
3 V
0 V
H
L
H
Normal operation
CE reset
Program starts from address 0.
Reset
signals
Clock stop status
STOP 0000B instruction
Clock stop released.
Oscillation starts.
L
H
L
H
L
H
L
H
L
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