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參數(shù)資料
| 型號(hào)： | UPD16675AW |
| 廠商： | NEC Corp. |
| 英文描述： | 1/34, 1/36 DUTY LCD CONTROLLER/DRIVER |
| 中文描述： | 1 / 34，1 / 36稅LCD控制器/驅(qū)動(dòng) |
| 文件頁數(shù)： | 29/36頁 |
| 文件大?。?/td> | 252K |
| 代理商： | UPD16675AW |
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29
μ
PD16675A
(2) Serial interface
Parameter
Symbol
Condition
MIN.
TYP.
MAX.
Unit
Shift clock cycle
t
CYK
SCK
900
ns
High level shift clock pulse
width
t
WHK
SCK
400
ns
Low level shift clock pulse
width
t
WLK
SCK
400
ns
Shift clock hold time
t
HSTBK
STB
↓→
SCK
↓
1.5
μ
s
Data setup time
t
DS1
DATA
→
SCK
↑
100
ns
Data hold time
t
DH1
SCK
↑→
DATA
400
ns
STB hold time
t
HKSTB
SCK
↑→
STB
↑
1
μ
s
STB pulse width
t
WSTB
1
μ
s
Wait time
t
WAIT
8th CLK
↑→
1st CLK
↓
1
μ
s
Remark
The TYP. value is a reference value when T
A
= 25
°
C.
(3) Parallel interface (8-bit/4-bit)
Parameter
Symbol
Condition
MIN.
TYP.
MAX.
Unit
Enable cycle time
t
CYCE
E
↑→
E
↑
900
ns
High level enable pulse width
t
WHE
E
400
ns
Low level enable pulse width
t
WLE
E
400
ns
STB pulse width
t
WSTB
1
μ
s
STB hold time
t
HKSTB
1
μ
s
Enable hold time
t
HSTBK
1.5
μ
s
Data setup time
t
DS2
D
0
to D
7
→
E
↑
100
ns
Data hold time
t
DH2
D
0
to D
7
→
E
↓
300
ns
Remarks 1.
The TYP. value is a reference value when T
A
= 25
°
C.
2.
In 4-bit parallel mode, D
0
to D
3
= “L”.
相關(guān)PDF資料 |
PDF描述 |
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