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參數(shù)資料
| 型號(hào)： | UM_S3C2501X |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | 2-WIRE FACTORY PROGRAMMED W/TIN PLATING |
| 中文描述： | 32位RISC微處理器 |
| 文件頁數(shù)： | 15/465頁 |
| 文件大?。?/td> | 1579K |
| 代理商： | UM_S3C2501X |
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S3C2501X
xv
List of Figures
(Continued)
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Title
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Number
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5-32
Read Timing Diagram 1 .........................................................................................5-29
Write Timing Diagram 1 .........................................................................................5-30
Read Timing Diagram 2 .........................................................................................5-31
Write Timing Diagram 2 .........................................................................................5-32
Read after Write at the Same Bank (COHDIS = 1).................................................5-33
Read Timing Diagram (Muxed Bus)........................................................................5-34
Write Timing Diagram (Muxed Bus) .......................................................................5-35
Write Timing Diagram (nEWAIT)............................................................................5-36
Write Timing Diagram (nREADY)...........................................................................5-37
SDRAM Configuration Register 0 ...........................................................................5-49
SDRAM Command Register...................................................................................5-51
SDRAM Refresh Timer Register.............................................................................5-52
SDRAM Write Buffer Time-out Register.................................................................5-53
Single Read Operation (CAS Latency=2)................................................................5-54
Single Read Operation (CAS Latency=3)................................................................5-55
Single Write Operation...........................................................................................5-56
Burst Read Operation (CAS Latency = 2)...............................................................5-57
Burst Read Operation (CAS Latency = 3)...............................................................5-58
Burst Write Operation.............................................................................................5-59
6-1
6-2
6-3
6-4
6-5
6-6
I
2
C Block Diagram..................................................................................................6-1
Master Transmitter and Slave Receiver..................................................................6-3
Master Receiver and Slave Transmitter..................................................................6-4
Start and Stop Conditions.......................................................................................6-5
Data Transfer Format.............................................................................................6-7
I
2
C Control Status Register.....................................................................................6-10
7-1
7-2
7-3
7-4
7-5
7-6
7-7
7-8
7-9
7-10
7-11
7-12
7-13
7-14
7-15
7-16
Ethernet Diagram...................................................................................................7-1
Data Structure of Tx Buffer Descriptor....................................................................7-10
Data Structure of Rx Buffer Descriptor ...................................................................7-11
Data Structure of the Receive Frame .....................................................................7-12
Fields of an IEEE802.3/Ethernet Frame .................................................................7-38
CSMA/CD Transmit Operation ...............................................................................7-40
Timing for Transmission without Collision...............................................................7-41
Timing for Transmission with Collision in Preamble................................................7-42
Receiving Frame without Error...............................................................................7-43
Receiving Frame with Error....................................................................................7-43
CSMA/CD Receive Operation ................................................................................7-44
MAC Control Frame Format...................................................................................7-46
Timing Relationship of Transmission Signals at MII................................................7-50
Timing Relationship of Reception Signals at MII.....................................................7-50
MDIO Sourced by PHY...........................................................................................7-50
MDIO Sourced by STA...........................................................................................7-50
8-1
DES/3DES Block Diagram .....................................................................................8-2
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UM_S3C49F9X | S3C49F9X User’s Manual |
| UM91610C | 14 STAGE RIPPLE-CARRY BINARY COUNTER/DIVIDERS |
| UM91611 | 8-STAGE STATIC SHIFT REGISTERS |
| UM9169 | 7 STAGE RIPPLE-CARRY BINARY COUNTER/DIVIDERS |
| UM92100 | TRIPLE 3-INPUT NOR GATE |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UMSA04A03T1V1 | 制造商:AAC 制造商全稱:American Accurate Components, Inc. 功能描述:UMS Ultra-Low Capacitance MAX Guard? ESD Suppressor (High Frequency Type) |
| UMSA04A03T1V2 | 制造商:AAC 制造商全稱:American Accurate Components, Inc. 功能描述:UMS Ultra-Low Capacitance MAX Guard? ESD Suppressor (High Frequency Type) |
| UMSA04A03T2V1 | 制造商:AAC 制造商全稱:American Accurate Components, Inc. 功能描述:UMS Ultra-Low Capacitance MAX Guard? ESD Suppressor (High Frequency Type) |
| UMSA04A03T2V2 | 制造商:AAC 制造商全稱:American Accurate Components, Inc. 功能描述:UMS Ultra-Low Capacitance MAX Guard? ESD Suppressor (High Frequency Type) |
| UMSA04A05T1V1 | 制造商:AAC 制造商全稱:American Accurate Components, Inc. 功能描述:UMS Ultra-Low Capacitance MAX Guard? ESD Suppressor (High Frequency Type) |
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