參數(shù)資料
型號： TS86101G2BMGS
廠商： ATMEL CORP
元件分類： DAC
英文描述： SERIAL INPUT LOADING, 10-BIT DAC, PBGA255
封裝： CI-CGA-255
文件頁數(shù)： 24/57頁
文件大?。?/td> 1119K
代理商： TS86101G2BMGS
30
5343C–BDC–03/06
TS86101G2B
Figure 8-2.
Detailed Timing Diagram
Note:
All timing parameters are defined under ”Definitions of Terms” on page 35.
Jitter = 300 ps p.p. max
1 CW Period
0
Phi 4
TPD
Tconv 1PipelineDelay
Data N + 1
Full-scale
Step
Data N + 2
Data N + 3
Data N -1
Data N - 2
Data N - 4
Data N - 5
Data N - 6
Data N - 7
Data N - 8
Data N - 3
Data In
Port A
Port B
Port C
Port D
Data Ready
(D_CK_T, D_CK_F)
1st Master Latches
Port A and Port B
Port C and Port D
1st Slave Latches
Port A and Port B
Port C and Port D
CW Master Clock
(CW_IN_T, CW_IN_F)
DSP Out
(DSP_CK_T, DSP_CK_F)
2nd Master Latches
Port A and Port B
Port C and Port D
2nd Slave Latches
Port A and Port B
Port C and Port D
4 - 1 MUX Output
3rd MS DAC Bank
Clock
DAC Bank
3rd Master Latches
DAC Bank
3rd Slave Latches
Analog Output
(OUT_T, OUT_F)
1 Vpp Single on 50
2 VPP Differential on 100
Propagation Delay TPD = Pipeline Delay + TOD = 1 Clock Cycle + TOD
TOD Includes Internal Propagation Delay: (Phi4, DAC Core Conversion Time and Package Propagation Delay)
Tdiv 4
+ Phi 3
Port Select A
Port Select B
Port Select C
Port Select D
Phi 4
Tmux
Phi 3
Clock Shift Range:
200 ps to 3.1 ns
(15 steps of 200 ps)
0000
Clock Shift
1111
TDSP
1 CW Period
Tdiv4 ~ 2 x Tdiv2
Delay ~
Tdiv2
F = 1.2 GHz
Tdiv2
Tdiv4 ~ 2 x Tdiv2
Delay ~
Tdiv2
Data Ready
D S P
Shift Select
DSP Clock Out
Clock
Shift
4 x 10
Data In
4
%2
Data Skew
0000
1111
Shift Range: 3.1 ns
0000
1111
Jitter = 300 ps p.p. max
Tsetup
Thold
TCW
CW/2 at TMV Output
CW/4 at TMV Output
CW/2 at TMV Output Delayed
CW Resynchro
(CW_IN_T, CW_IN_F)
CW/2
CW/4
相關(guān)PDF資料
PDF描述
TS86101G2BMGS PARALLEL, WORD INPUT LOADING, 10-BIT DAC, CBGA255
TS86101G2BVGL PARALLEL, WORD INPUT LOADING, 10-BIT DAC, CBGA255
TS86101G2BCGL PARALLEL, WORD INPUT LOADING, 10-BIT DAC, CBGA255
TSA0801IF 1-CH 8-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PQFP48
TSA0801CFT 1-CH 8-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PQFP48
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參數(shù)描述
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