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參數(shù)資料
| 型號(hào)： | TS68EN360MA25L |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-bit Quad Integrated Communication Controller |
| 中文描述： | 32-BIT, 25 MHz, RISC PROCESSOR, CQFP240 |
| 封裝： | CERAMIC, LCC-240 |
| 文件頁(yè)數(shù)： | 56/82頁(yè) |
| 文件大小： | 874K |
| 代理商： | TS68EN360MA25L |
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56
TS68EN360
2113A–HIREL–03/02
Notes:
1. TheratioSyncCLK/L1RCLKmustbegreaterthan2.5/1.
2. WhereP=1/CLKO1.Thusfora25MHzCLKO1rate,P=40ns.
3. ThesespecsarevalidforIDLmodeonly.
4. ThestrobesandTxdonthefirstbitoftheframebecomevalidafterL1CLKedgeorL1SYNC,whicheverislater.
SIElectricalSpecifications
GND=0V
DC,
T
C
=-55to+125
°
C.Theelectricalspecificationsinthisdocumentarepreliminary
(SeeFigure50toFigure54).
Number
Characteristic
25.0MHz
33.34MHz
Unit
Min
Max
Min
Max
70
(1)(3)
L1RCLK,L1TCLKFrequency(DCS=0)
-
10
-
10
MHz
71
(1)
L1RCLK,L1TCLKWidthLow(DCS=0)
P+10
-
P+10
-
ns
71A
(2)
L1RCLK,L1TCLKWidthHigh(DCS=0)
P+10
-
P+10
-
ns
72
L1TXD,L1ST(1-4),L1RQ,L1CLKORise/FallTime
-
15
-
15
ns
73
L1RSYNC,L1TSYNCValidtoL1CLKEdge(SYNCSetupTime)
20
-
20
-
ns
74
L1CLKEdgetoL1RSYNC,L1TSYNCInvalid(SYNCHoldTime)
35
-
35
-
ns
75
L1RSYNC,L1TSYNCRise/FallTime
-
15
-
15
ns
76
L1RXDValidtoL1CLKEdge(L1RXDSetupTime)
42
-
42
-
ns
77
L1CLKEdgetoL1RXDInvalid(L1RXDHoldTime)
35
-
35
-
ns
78
L1CLKEdgetoL1ST(1-4)Valid
10
45
10
45
ns
78A
(4)
L1SYNCValidtoL1ST(1-4)Valid
10
45
10
45
ns
79
L1CLKEdgetoL1ST(1-4)Invalid
10
45
10
45
ns
80
L1CLKEdgetoL1TXDValid
10
65
10
65
ns
80A
(4)
L1TSYNCValidtoL1TXDValid
10
65
10
65
ns
81
L1CLKEdgetoL1TXDHighImpedance
0
42
0
42
ns
82
L1RCLK,L1TCLKFrequency(DSC=1)
-
12.5
-
16
MHz
83
L1RCLK,L1TCLKWidthLow(DSC=1)
P+10
-
P+10
-
ns
83A
(2)
L1RCLK,L1TCLKWidthHigh(DSC=1)
P+10
-
P+10
-
ns
84
L1CLKEdgetoL1CLKOValid(DSC=1)
-
30
-
30
ns
85
(3)
L1RQValidBeforeFallingEdgeofL1TSYNC
1
-
1
-
L1TCLK
86
(3)
L1GRSetupTime
42
-
42
-
ns
87
(3)
L1RGHoldTime
42
-
42
-
ns
88
L1CLKEdgetoL1SYNCValid(FSD=00,CNT=0000,BYT=0,
DSC=0)
-
0
-
0
ns
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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