參數(shù)資料
型號： TPS5602IDBT
元件分類： 基準電壓源/電流源
英文描述： Voltage-Mode SMPS Controller
中文描述： 電壓模式開關(guān)電源控制器
文件頁數(shù)： 9/34頁
文件大?。?/td> 811K
代理商： TPS5602IDBT
TPS56302
DUAL-OUTPUT LOW-INPUT-VOLTAGE
DSP POWER SUPPLY CONTROLLER WITH SEQUENCING
SLVS289A
–
MARCH 2000
–
REVISED OCTOBER 2000
9
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
electrical characteristics T
J
= 0
°
to 125
°
C, V
CC
= 2.8 V to 5.5 V (unless otherwise noted) (continued)
high-side VDS sensing
PARAMETER
CONDITIONS
MIN
TYP
MAX
UNITS
Gain
2
V/V
Initial accuracy
VHISENSE = 3.3 V,
Differential input to Vds sensing amp = 100 mV
VIOUTLO = 3.2 V,
194
208
mV
Common-mode rejection ratio
VHISENSE=2.8 V to 5.5 V,
VHISENSE
–
VIOUTLO=100 mV
2.8 V < VIOUTLO < 5.5 V
VIOUT = 0.5 V,
VIOUTLO=2.8 V
VIOUT = 0.05 V,
VIOUTLO=3.3 V
VHISENSE=5.5 V,
VHISENSE=4.5 V,
VHISENSE=3 V,
VHISENSE=2.8 V,
VHISENSE=2.8 V,
VHISENSE=4.5 V,
VHISENSE=4.5 V,
VHISENSE=5.5 V,
VHISENSE=5.5 V,
VHISENSE = 6 V,
VHISENSE = 4.5 V,
VHISENSE = 3.6 V,
VHISENSE = 2.8 V,
VHISENSE = 2.55 V,
VIOUTLO pulsed from 2.55 V to 2.45 V,
100 ns rise and fall times,
69
75
dB
Sink current (IOUTLO)
250
nA
Source current (IOUT)
VHISENSE=3.3 V,
500
μ
A
Sink current (IOUT)
VHISENSE=3.35 V,
50
μ
A
RIOUT = 10 k
RIOUT = 10 k
RIOUT = 10 k
See Note 2
0
1.75
Output voltage swing
0
1.5
V
0
0.75
LOSENSE high-level input voltage
1.77
V
LOSENSE low-level input voltage
See Note 2
1.49
V
LOSENSE high-level input voltage
See Note 2
2.85
V
LOSENSE low-level input voltage
See Note 2
2.4
V
LOSENSE high-level input voltage
See Note 2
3.80
V
LOSENSE low-level input voltage
See Note 2
3.2
V
See Note 2
70
90
Sample/hold resistance
See Note 2
80
100
See Note 2
90
120
See Note 2
120
180
See Note 2
4
Response time (measured from 90% of
VIOUTLO to 90% of VIOUT)
VHISENSE = 2.8 V,
VIOUTLO pulsed from 2.8 V to 2.7 V,
100 ns rise and fall times,
See Note 2
3.5
μ
s
VHISENSE = 4.5 V,
VIOUTLO pulsed from 4.5 V to 4.4 V,
100 ns rise and fall times,
See Note 2
3
VHISENSE = 5.5 V,
VIOUTLO pulsed from 5.5 V to 5.9 V,
100 ns rise and fall times,
See Note 2
3
Short circuit protection rising edge delay
LOSENSE grounded,
See Note 2
300
500
ns
Sample/hold switch turnon/turnoff delay
2.8 V < VHISENSE < 5.5 V,
VLOSENSE = VHISENSE,
See Note 2
30
100
ns
NOTE 2. Ensured by design, not production tested.
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