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參數(shù)資料
| 型號： | TMS370C686AFNT |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8-BIT MICROCONTROLLER |
| 中文描述： | 8位微控制器 |
| 文件頁數(shù)： | 14/48頁 |
| 文件大?。?/td> | 711K |
| 代理商： | TMS370C686AFNT |
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TMS370Cx36
8-BIT MICROCONTROLLER
SPNS039B – JANUARY 1996 – REVISED FEBRUARY 1997
14
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
interrupts (continued)
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á
á
á
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ááááááááááááááááááááááááá
PACT (Group 3)
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Release microcontroller from STANDBY and HALT low-power modes
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áááá
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INT1
INTERRUPT
á
á
External RESET
Watchdog Overflow
Oscillator Fault
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External Interrupt 1
INTERRUPT
á
á
COLD START
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áááá
INT1 FLAG
á
á
ááá
ááá
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INT1
SYSTEM
á
á
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áááá
áááá
7FFCh, 7FFDh
6
VECTOR
á
á
áá
áá
áá
2
á
á
GROUP
áá
á
á
PRIORITY
IN
á
á
á
á
á
á
á
SPI
SPI RX/TX Complete
SPI INT FLAG
SPIINT
BUFINT
7FF6h, 7FF7h
ááá
7FB0h, 7FB1h
3
ááááááá
á
áááá
á
á
áááá
á
á
1
áá
á
ááááááááááááááááááááááááá
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PACT CP4 Event
CP4 INT FLAG
CP4INT
7FB6h, 7FB7h
4
áááá
áááááááááááááááááááááááááááááá
PACT CP3 Event
PACT CP1 Event
CP3 INT FLAG
CP1 INT FLAG
CP3INT
CP1INT
7FB8h, 7FB9h
7FBCh, 7FBDh
áá
5
7
PACT CP2 Event
CP2 INT FLAG
CP2INT
7FBAh, 7FBBh
6
ááá
áááá
7FBEh, 7FBFh
7F9Eh, 7F9Fh
áá
8
1
á
PACT SCI Rx Int
á
PACT RX RDY
Default Timer
á
PRXINT
á
á
á
á
áááááááááááááááááááááááááááááá
áááááááááááááááááááááááááááááá
PACT (Group 3)
áááááááááááááááááááááááááááááá
ADC1
PACT SCI Tx Int
PACT TX RDY
PTXINT
7F9Ch, 7F9Dh
6
7
2
PACT Cmd/Def Entry 0
PACT Cmd/Def Entry 2
CMD/DEF INT 0 FLAG
CMD/DEF INT 2 FLAG
CDINT 0
CDINT 2
7FA0h, 7FA1h
7FA4h, 7FA5h
1
3
PACT Cmd/Def Entry 1
CMD/DEF INT 1 FLAG
CDINT 1
7FA2h, 7FA3h
2
áááá
PACT Cmd/Def Entry 6
CMD/DEF INT 6 FLAG
CDINT 6
7FACh, 7FADh
7
ADC1 Conversion Complete
AD INT FLAG
ADINT
7FECh, 7FEDh
áááá
privileged operation and EEPROM write protection override
The TMS370Cx36 family is designed with significant flexibility to enable the designer to software-configure the
system and peripherals to meet the requirements of a variety of applications. The nonprivileged mode of
operation ensures the integrity of the system configuration, once it is defined for an application. Following a
hardware reset, the TMS370Cx36 operates in the privileged mode, where all peripheral file registers have
unrestricted read/write access, and the application program configures the system during the initialization
sequence following reset. As the last step of system initialization, the PRIVILEGE DISABLE bit (SCCR2.0) is
set to 1 to enter the nonprivileged mode, disabling write operations to specific configuration-control bits within
the PF. Table 8 lists the control bits shown in the table which are write-protected during the nonprivileged mode
and must be configured by software prior to exiting the privileged mode.
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PDF描述 |
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