參數(shù)資料
型號: TMS320C6203BGLSA300
英文描述: DSP|32-BIT|CMOS|BGA|384PIN|PLASTIC
中文描述: 數(shù)字信號處理器| 32位|的CMOS | BGA封裝| 384PIN |塑料
文件頁數(shù): 94/132頁
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代理商: TMS320C6203BGLSA300
SPRS145G
JULY 2000
REVISED FEBRUARY 2002
94
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251
1443
PARAMETER MEASUREMENT INFORMATION
9
4
SPISOMI
SPISIMO
SPICLK
(clock polarity = 1)
SPICLK
(clock polarity = 0)
Master In Data
Must Be Valid
Master Out Data Is Valid
8
5
3
2
1
SPISTE
The SPISTE signal must be active before the SPI communication stream starts; the SPISTE signal must remain active
until the SPI communication stream is complete.
Figure 40. SPI Master Mode External Timing (Clock Phase = 0)
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PDF描述
TMS320C6203BGNY250 DSP|32-BIT|CMOS|BGA|384PIN|PLASTIC
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參數(shù)描述
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