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參數(shù)資料
| 型號(hào)： | T89C51SND1-ROTIL |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Single Chip Microcontroller with MP3 Decoder and Man Machine Interface |
| 中文描述： | 8-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | TQFP-80 |
| 文件頁數(shù)： | 107/170頁 |
| 文件大小： | 1927K |
| 代理商： | T89C51SND1-ROTIL |
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107
A/T89C51CC01
4129L–CAN–08/05
Table 69.
CANIE2 Register
CANIE2 (S:C3h)
CAN Enable Interrupt Message Object Registers 2
Reset Value = 0000 0000b
Table 70.
CANBT1 Register
CANBT1 (S:B4h)
CAN Bit Timing Registers 1
Note:
The CAN controller bit timing registers must be accessed only if the CAN controller is dis-
abled with the ENA bit of the CANGCON register set to 0.
See Figure 48.
No default value after reset.
7
6
5
4
3
2
1
0
IECH 7
IECH 6
IECH 5
IECH 4
IECH 3
IECH 2
IECH 1
IECH 0
Bit
Number
Bit Mnemonic Description
7-0
IECH7:0
Enable interrupt by Message Object
0 - disable IT.
1 - enable IT.
IECH7:0 = 0b 0000 1100 -> Enable IT’s of message objects 3 and 2.
7
6
5
4
3
2
1
0
-
BRP 5
BRP 4
BRP 3
BRP 2
BRP 1
BRP 0
-
Bit
Number
Bit Mnemonic Description
7
-
Reserved
The value read from this bit is indeterminate. Do not set this bit.
6-1
BRP5:0
Baud rate prescaler
The period of the CAN controller system clock Tscl is programmable and
determines the individual bit timing.
0
-
Reserved
The value read from this bit is indeterminate. Do not set this bit.
Tscl =
BRP[5..0] + 1
Fcan
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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