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參數(shù)資料
| 型號： | T89C51RD2-RLFC-M |
| 廠商： | Atmel Corp. |
| 英文描述： | 0 to 40MHz Flash Programmable 8-bit Microcontroller |
| 中文描述： | 0至40MHz可編程閃存8位微控制器 |
| 文件頁數(shù)： | 109/170頁 |
| 文件大小： | 1927K |
| 代理商： | T89C51RD2-RLFC-M |
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109
A/T89C51CC01
4129L–CAN–08/05
Table 72.
CANBT3 Register
CANBT3 (S:B6h)
CAN Bit Timing Registers 3
Note:
The CAN controller bit timing registers must be accessed only if the CAN controller is dis-
abled with the ENA bit of the CANGCON register set to 0.
See Figure 48.
No default value after reset.
7
6
5
4
3
2
1
0
-
PHS2 2
PHS2 1
PHS2 0
PHS1 2
PHS1 1
PHS1 0
SMP
Bit
Number
Bit Mnemonic Description
7
-
Reserved
The value read from this bit is indeterminate. Do not set this bit.
6-4
PHS2 2:0
Phase Segment 2
This phase is used to compensate for phase edge errors. This segment can
be shortened by the re-synchronization jump width.
Phase segment 2 is the maximum of Phase segment1 and the Information
Processing Time (= 2TQ).
3-1
PHS1 2:0
Phase Segment 1
This phase is used to compensate for phase edge errors. This segment can
be lengthened by the re-synchronization jump width.
0
SMP
Sample Type
0 - once, at the sample point.
1 - three times, the threefold sampling of the bus is the sample point and twice
over a distance of a 1/2 period of the Tscl. The result corresponds to the
majority decision of the three values.
Tphs2 = Tscl x (PHS2[2..0] + 1)
Tphs1 = Tscl x (PHS1[2..0] + 1)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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