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參數(shù)資料
| 型號： | T6818-TUQ |
| 廠商： | ATMEL CORP |
| 元件分類： | 外設及接口 |
| 英文描述： | Triple Halfbridge DMOS OUTPUT DRIVER WITH SERIAL INPUT CONTROL |
| 中文描述： | HALF BRIDGE BASED PRPHL DRVR, PDSO14 |
| 封裝： | POWER, SO-14 |
| 文件頁數(shù)： | 8/16頁 |
| 文件大小： | 469K |
| 代理商： | T6818-TUQ |
8
T6818/T6828
4530C–BCD–11/03
Note:
1. Test pulse 5: V
smax
= 40 V
Noise and Surge Immunity
Parameters
Test Conditions
Value
Level 4
(1)
Conducted interferences
ISO 7637-1
Interference suppression
VDE 0879 Part 2
Level 5
ESD (Human Body Model)
ESD S 5.1
2 kV
ESD (Machine Model)
JEDEC A115A
200 V
Electrical Characteristics
7.5 V < V
VS
< 40 V; 4.75 V < V
VCC
< 5.25 V; INH = High; -40 C < T
j
< 150 C; unless otherwise specified, all values refer to GND pins.
No.
Parameters
Test Conditions
Pin
1
Current Consumption
Symbol
Min.
Typ.
Max.
Unit
Type*
1.1
Quiescent current VS
V
VS
< 20 V, INH = low
4.75 V < V
VCC
< 5.25 V,
INH = low
3
I
VS
1
5
μA
A
1.2
Quiescent current VCC
11
I
VCC
15
25
μA
A
1.3
Supply current VS
V
VS
<20 V normal
operating, all outputs off
3
I
VS
4
6
mA
A
1.4
Supply current VCC
4.75 V < V
VCC
< 5.25 V,
normal operating
11
I
VCC
350
500
μA
A
1.5
Discharge current VS
V
VS
= 32.5 V,
INH = low
3
I
VS
0.5
5.5
mA
A
1.6
Discharge current VS
V
VS
= 40 V,
INH = low
3
I
VS
2.5
10
mA
A
2
Undervoltage Detection, Power-on Reset
2.1
Power-on reset
threshold
11
V
VCC
3.2
3.9
4.4
V
A
2.2
Power-on reset
delay time
After switching on V
CC
t
dPor
30
95
190
μs
A
2.3
Undervoltage-detection
threshold
V
CC
= 5 V
3
V
Uv
5.6
7.0
V
A
2.4
Undervoltage-detection
hysteresis
V
CC
= 5 V
3
V
Uv
0.6
V
A
2.5
Undervoltage-detection
delay time
Thermal Prewarning and Shutdown
t
dUV
10
40
μs
A
3
3.1
Thermal prewarning set
T
jPW set
120
145
170
C
B
3.2
Thermal prewarning
reset
T
jPW reset
105
130
155
C
B
3.3
Thermal prewarning
hysteresis
T
jPW
15
C
B
3.4
Thermal shutdown off
T
j switch off
T
j switch on
150
175
200
C
B
3.5
Thermal shutdown on
135
160
185
C
B
*) Type means: A =100% tested, B = 100% correlation tested, C = Characterized on samples, D = Design parameter
Note:
1. Delay time between rising edge of input signal at pin CS after data transmission and switch on output stages to 90% of final
level. Device not in standby for t > 1 ms
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PDF描述 |
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