Precision Edge SY89808L Micrel, Inc. M9999-091405 hbwhelp@micrel.com or (408) 955-1690 Pin Number Pin" />
參數(shù)資料
型號(hào)： SY89808LTI
廠商： Micrel Inc
文件頁(yè)數(shù)： 2/5頁(yè)
文件大?。?/td> 0K
描述： IC CLK BUF MUX TRNSLA 2:9 32TQFP
標(biāo)準(zhǔn)包裝： 250
系列： Precision Edge®
類型： 扇出緩沖器（分配），多路復(fù)用器，變換器
電路數(shù)： 1
比率 - 輸入:輸出： 2:9
差分 - 輸入:輸出： 是/是
輸入： HSTL，LVPECL
輸出： HSTL
頻率 - 最大： 500MHz
電源電壓： 3.15 V ~ 3.45 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-TQFP
供應(yīng)商設(shè)備封裝： 32-TQFP
包裝： 托盤
2
Precision Edge
SY89808L
Micrel, Inc.
M9999-091405
hbwhelp@micrel.com or (408) 955-1690
Pin Number
Pin Name
Type
Pin Function
2, 3
HSTL_CLK,
HSTL
Differential clock input selected by CLK_SEL. Can be left floating if not
/HSTL_CLK
Input
selected. Floating input, if selected produces an indeterminate output. HSTL
input signal requires external termination 50
to GND.
5, 6
LVPECL_CLK,
LVPECL
Differential clock input selected by CLK_SEL. Can be left floating. Floating
/LVPECL_CLK
Input
input, if selected produces a LOW at the output (internal 75
pull-downs).
Requires external termination. 75k
pull-up.
4
CLK_SEL
LVTTL
Selects HSTL_CLK input when LOW and LVPECL_CLK output when HIGH.
Input
11k
pull-up.
8
OE
LVTTL
Enable input synchronized internally to prevent glitching of the Q0-Q8 and
Input
/Q0-/Q8 outputs. Must be a minimum of three clock periods wide if
synchronous with the CLK inputs and must meet the tS and tH requirements
(refer to AC Electrical Characteristics). If asynchronous, must be a minimum
of four clock periods wide. 11k
pull-up.
31, 29, 27, 23,
Q0–Q8
HSTL
Differential clock outputs from HSTL_CLK when CLK_SEL = LOW and
21, 19, 15, 13,
Output
LVPECL outputs when CLK_SEL = HIGH. HSTL outputs must be terminated
11
with 50
to GND. Q0–Q8 outputs are static LOW when OE = LOW. Unused
output pairs may be left floating.
30, 28, 26, 22,
/Q0–/Q8
HSTL
Differential clock outputs from HSTL_CLK when CLK_SEL = LOW and
20, 18, 14, 12,
Output
LVPECL outputs when CLK_SEL = HIGH. HSTL outputs must be terminated
10
with 50
to GND. /Q0–/Q8 outputs are static HIGH when OE = LOW.
Unused output pairs may be left floating.
1
VCCI
VCC Core
Core VCC connected to 3.3V supply. Bypass with 0.1F in parallel with
Power
0.01
F low ESR capacitors as close to V
CCI pin as possible.
9, 16, 17, 24,
VCCO
VCC Output
Output Buffer VCC connected to 1.8V supply. Bypass with 0.1F in parallel
25, 32
Power
with 0.01
F low ESR capacitors as close to V
CCO pins as possible. All VCCO
pins should be connected together on the PCB.
7
GND
Ground
Ground.
PACKAGE/ORDERING INFORMATION
32 31 30 29 28 27 26 25
9
1011 12 131415 16
1
2
3
4
5
6
7
8
24
23
22
21
20
19
18
17
VCCI
HSTL_CLK
/HSTL_CLK
CLK_SEL
LVPECL_CLK
/LVPECL_CLK
GND
OE
VCCO
Q3
/Q3
Q4
/Q4
Q5
/Q5
VCCO
Q0
/Q0
Q1
/Q1
Q2
/Q2
VCCO
/Q8
Q8
/Q7
Q7
/Q6
Top View
Q6
VCCO
32-Pin TQFP (T32-1)
PIN DESCRIPTION
Ordering Information(1)
Package
Operating
Package
Lead
Part Number
Type
Range
Marking
Finish
SY89808LTI
T32-1
Industrial
SY89808LTI
Sn-Pb
SY89808LTITR(2)
T32-1
Industrial
SY89808LTI
Sn-Pb
SY89808LTG(3)
T32-1
Industrial
SY89808LTG with
NiPdAu
Pb-Free bar line indicator Pb-Free
SY89808LTGTR(2, 3)
T32-1
Industrial
SY89808LTG with
NiPdAu
Pb-Free bar line indicator Pb-Free
Notes:
1. Contact factory for die availability. Dice are guaranteed at T
A = 25°C, DC Electricals only.
2. Tape and Reel.
3. Pb-Free package is recommended for new designs.
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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