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參數(shù)資料
| 型號(hào)： | SY10EL34LZI TR |
| 廠商： | Micrel Inc |
| 文件頁(yè)數(shù)： | 6/7頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK GEN /2/4/6 5V/3.3V 16SOIC |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | 10EL, Precision Edge® |
| 類(lèi)型： | 時(shí)鐘發(fā)生器 |
| PLL： | 無(wú) |
| 輸入： | ECL，PECL |
| 輸出： | 時(shí)鐘 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:3 |
| 差分 - 輸入:輸出： | 是/是 |
| 除法器/乘法器： | 是/無(wú) |
| 電源電壓： | 3 V ~ 3.8 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類(lèi)型： | 表面貼裝 |
| 封裝/外殼： | 16-SOIC（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 16-SOIC |
| 包裝： | 帶卷 (TR) |
| 其它名稱(chēng)： | SY10EL34LZITR SY10EL34LZITR-ND |
Micrel, Inc.
Precision Edge
SY100EL34/L
December 2011
7
M9999-120611-I
hbwhelp@micrel.com or (408) 955-1690
Timing Diagram
The EN signal will freeze the internal clocks to the flip-flops on the first falling edge of CLK after its assertion. The internal
dividers will maintain their state during the internal clock freeze and will return to clocking once the internal clocks are
unfrozen. The outputs will transition to their next states in the same manner, time and relationship as they would have had
the EN signal not been asserted.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| SY10EL34ZG | 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 3.3V /2, /4. /8 Clock Generation Chip (I Temp, Green) RoHS:否 制造商:Silicon Labs 類(lèi)型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
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