參數(shù)資料
型號: SY100S302JZ
廠商: Micrel Inc
文件頁數(shù): 1/4頁
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描述: IC GATE OR/NOR QUINT 2IN 28-PLCC
標準包裝: 38
系列: 100S
邏輯類型: 或非門/或門
電路數(shù): 5
輸入數(shù): 10 輸入(2,2,2,2,2)
施密特觸發(fā)器輸入:
輸出類型: 差分
電源電壓: 4.2 V ~ 5.5 V
工作溫度: 0°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 28-LCC(J 形引線)
供應商設備封裝: 28-PLCC
包裝: 管件
1
SY100S302
Micrel, Inc.
M9999-042307
hbwhelp@micrel.com or (408) 955-1690
s Max. propagation delay of 700ps
s IEE min. of –45mA
s Industry standard 100K ECL levels
s Extended supply voltage option:
VEE = –4.2V to –5.5V
s Voltage and temperature compensation for
improved noise immunity
s Internal 75k
input pull-down resistors
s 50% faster than Fairchild 300K
s Function and pinout compatible with Fairchild F100K
s Available in 28-pin PLCC package
DESCRIPTION
The SY100S302 offers five 2-input OR/NOR gates
designed for use in high-performance ECL systems. The
five gates are controlled by a common Enable signal. All
inputs have 75k
pull-down resistors and all outputs are
buffered.
SY100S302
QUINT 2-INPUT
OR/NOR GATE
BLOCK DIAGRAM
Oa
D1a
D2a
Ob
D1b
D2b
Oc
D1c
D2c
Od
D1d
D2d
Oe
D1e
D2e
E
FEATURES
Rev.: I
Amendment: /0
Issue Date:
April 2007
Pin
Function
Dna – Dne
Data Inputs (n-1...5)
E
Enable Input
Oa – Oe
Data Outputs
Oa – Oe
Complementary Data Outputs
VEES
VEE Substrate
VCCA
VCCO for ECL Outputs
PIN NAMES
相關PDF資料
PDF描述
TXR40AB00-2207AI ADPTR TINEL LOCK STR SHELL 23, H
SY100S301JZ IC GATE OR/NOR TRPL 5INP 28-PLCC
SY10E107JZ IC GATE XOR/XNOR QUINT 28-PLCC
ELFB04280 CONN HEADER 4POS .200" VERT BLK
TXR21AB00-1812AI ADPTR TINEL LOCK STR SHELL 18
相關代理商/技術參數(shù)
參數(shù)描述
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