參數(shù)資料
型號： SY100EPT20VZG TR
廠商： Micrel Inc
文件頁數(shù)： 3/6頁
文件大?。?/td> 0K
描述： IC TRANSLATOR 3.3/5V 8-SOIC
標準包裝： 1,000
系列： 100EPT
邏輯功能： 變換器
位數(shù)： 1
輸入類型： LVCMOS，LVTTL
輸出類型： LVPECL
通道數(shù)： 1
輸出/通道數(shù)目： 1
差分 - 輸入:輸出： 無/是
傳輸延遲（最大）： 0.6ns
電源電壓： 3.3V，5V
工作溫度： -40°C ~ 85°C
封裝/外殼： 8-SOIC（0.154"，3.90mm 寬）
供應商設備封裝： 8-SOIC
包裝： 帶卷 (TR)
其它名稱： SY100EPT20VZGTR
SY100EPT20VZGTR-ND
Technical Note
3/15
www.rohm.com
2010.10 - Rev.A
2010 ROHM Co., Ltd. All rights reserved.
BD3870FS,BD3871FS,BD3872FS,BD3873FS
SC
(CLOCK)
thd
th
ts
ts1
th1
tsd
twc
twh
twd
tw1
tsu
DATA
LATCH
90%
10%
90%
10%
twc
End with Low
SI
DATA
LATCH
●
Timing chart
1) Signal Timing Conditions
·
Data is read on the rising edge of the clock.
·
Latch is read out on the falling edge of the clock.
·
Latch signal must end with the LOW state.
·
To avoid malfunctions, clock and data signals must terminate with the LOW state.
1byte=10bit
Fig.1
Parameter
Symbol
Limits
Unit
Min.
Typ.
Max.
Minimum Clock Width
Twc
2.0
-
s
Minimum Data Width
twd
2.0
-
s
Minimum Latch Width
Tw1
2.0
-
s
Data Set-up Time (DATA
CLK)
Tsd
1.0
-
s
Data Hold Time (CLK
DATA)
Thd
1.0
-
s
Latch Set-up Time (CLK
LATCH)
Ts1
1.0
-
s
Latch Hold Time (DATA
LATCH)
Th1
1.0
-
s
Latch Low Set-up Time
Ts
1.0
-
s
Latch Low Hold Width
Twh
2.0
-
s
2) Voltage Conditions for Control Signals
Parameter
Limits
Unit
Condition
Min.
Typ.
Max.
(≦Vcc)
“H” Input Voltage
2.2
-
5.5
V
Vcc=4.5 to 9.5V
“L” Input Voltage
0
-
1.0
V
Vcc=4.5 to 9.5V
相關PDF資料
PDF描述
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參數(shù)描述
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