參數資料
型號： SY100EL35LZI
廠商： MICREL INC
元件分類： 通用總線功能
英文描述： JK FLIP-FLOP
中文描述： 100EL SERIES, POSITIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO8
封裝： 0.150 INCH, SOIC-8
文件頁數： 1/4頁
文件大?。?/td> 57K
代理商： SY100EL35LZI
1
1
SY10EL35
SY10EL35
SY100EL35
Micrel, Inc.
M9999-121205
hbwhelp@micrel.com or (408) 955-1690
DESCRIPTION
FEATURES
JK FLIP-FLOP
J
K
R
CLK
Qn+1
L
L
L
Z
Qn
L
H
L
Z
L
H
L
L
Z
H
H
H
L
Z
Qn
X
X
H
X
L
NOTE:
1. Z = LOW-to-HIGH transition.
TRUTH TABLE
(1)
I
525ps propagation delay
I
2.2GHz toggle frequency
I
High bandwidth output transistions
I
Internal 75K
input pull-down resistors
I
Available in 8-pin SOIC package
The SY10/100EL35 are high-speed JK Flip-Flops. The
J/K data enters the master portion of the flip-flop when
the clock is LOW and is transferred to the slave and,
thus, the outputs, upon a positive transition of the clock.
The reset pin is asynchronous and is activated with a
logic HIGH.
Rev.: G
Issue Date:
Amendment: /0
December 2005
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PDF描述
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