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參數(shù)資料
| 型號： | STA538B |
| 廠商： | 意法半導體 |
| 英文描述： | Zener Diode; Application: General; Pd (mW): 400; Vz (V): 25.63 to 26.95; Condition Iz at Vz (mA): 5; C (pF) max: -; Condition VR at C (V):   ESD (kV) min: -; Package: MHD |
| 中文描述： | 2個為1.3 W D類與模擬或數(shù)字輸入2.0多聲道數(shù)字音頻處理器與最終幻想放大器 |
| 文件頁數(shù)： | 44/59頁 |
| 文件大?。?/td> | 402K |
| 代理商： | STA538B |
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Registers
STA538
44/59
P2SCFG0
Parallel-to-serial audio interface configuration
register 0
Address:
0x0C
Type:
R/W
Buffer:
No
Reset:
0xD3
Description:
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
BICLK_ STRB
LRCLK_LEFT
SDATAO_ACT
MSB_FIRST
DATA_FORMAT[2:0]
MASTER_
MODE
7 BICLK_STRB: defines the bit clock edges:
0: strobe is falling edge, active edge is rising
1: strobe is rising edge, active edge is falling (default)
6 LRCLK_LEFT: defines the channel for the LR clock:
0: clock is low for left channel, high for right channel
1: clock is high for left channel, low for right channel (default)
5 SDATAO_ ACT: sets the behavior of pin SDATAO:
0: output is tri-stated when no data is sent (default)
1: output is never in tri-state (it is 0 when no data is sent)
4 MSB_FIRST: data alignment in the protocol for SDATAI and SDATAO:
0: LSB is the first bit
1: MSB is the first bit (default)
3:1 DATA_FORMAT[2:0]: serial interface protocol format:
000: left justified
001: I
2
S (default)
010: right justified
100: PCM no delay
101: PCM delay
111: DSP
0 MASTER_ MODE: selects serial interface master/slave mode:
0: slave
1: master (default)
相關PDF資料 |
PDF描述 |
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| STA538Q | Zener Diode; Application: General; Pd (mW): 400; Vz (V): 26.29 to 27.64; Condition Iz at Vz (mA): 5; C (pF) max: -; Condition VR at C (V):   ESD (kV) min: -; Package: MHD |
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參數(shù)描述 |
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