參數(shù)資料
型號(hào): ST92E195
英文描述: 48-96 KBYTE ROM HCMOS MCU WITH ON-SCREEN DISPLAY AND TELETEXT DATA SLICER
中文描述: 48-96字節(jié)ROM HCMOS微控制器對(duì)顯示屏和圖文電視數(shù)據(jù)限幅器
文件頁數(shù): 185/249頁
文件大?。?/td> 2938K
代理商: ST92E195
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ST92195 ST92T195 ST92E195 - TWO-CHANNEL I
2
C BUS INTERFACE (I2C)
I
2
C BUS INTERFACE
(Cont’d)
7.10.2 General Description
In addition to receiving and transmitting data, this
interface convert them from serial to parallel for-
mat and vice versa. The interface is connected,
through a multiplexer, to one I
2
C bus among 2 by a
data pin, SDAx, and by a clock pin, SCLx, where x
range value is 1 to 2.
It can be connected both with a standard I
2
C bus
and a Fast I
2
C bus. This selection is made by soft-
ware.
7.10.2.1 Mode Selection
The interface can operate in the four following
modes:
– Slave transmitter/receiver
– Master transmitter/receiver
By default, it operates in slave mode.
The interface automatically switches from inactive
slave to master after it generates a START condi-
tion and from master to inactive slave in case of ar-
bitration loss or a STOP generation, this allows
Multi-Master capability.
7.10.2.2 Communication Flow
In Master mode, it initiates a data transfer and
generates the clock signal. A serial data transfer
always begins with a start condition and ends with
a stop condition. Start condition is automatically
generated by the interface when the data register
is loaded by the slave address (see register de-
scription for further details). Stop condition is gen-
erated in master mode by writing by software in
the control register.
In Slave mode, the interface is capable of recog-
nising its own address (7-bit), and the General Call
address. The General Call address detection may
be enabled or disabled by software.
Data and addresses are transferred as 8-bit bytes,
MSB first. The first byte following the start condi-
tion is the address byte; it is always transmitted in
Master mode.
A 9th clock pulse follows the 8 clock cycles of a
byte transfer, during which the receiver must send
an acknowledge bit to the transmitter. Refer to
Fig-
ure 1
.
The acknowledge may be enabled and disabled
by software.
The speed of the I
2
C interface may be selected
between Standard (15.625 - 100 kHz), Fast I
2
C
(100- 400 kHz), or Extended I
2
C (500 - 800 kHz).
Figure 104. I
2
C bus protocol
SCL
SDA
1
2
8
9
MSB
ACK
STOP
CONDITION
START
CONDITION
VR02119B
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PDF描述
ST92F120JV1 8/16-BIT FLASH MCU FAMILY WITH RAM. EEPROM AND J1850 BLPD
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ST92F124V1QB 功能描述:8位微控制器 -MCU Flash 128K 2SCI/SPI RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT