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參數(shù)資料
| 型號： | ST92124JV9Q6 |
| 廠商： | 意法半導體 |
| 英文描述： | 8/16-BIT SINGLE VOLTAGE FLASH MCU FAMILY WITH RAM, E3 TMEMULATED EEPROM, CAN 2.0B AND J1850 BLPD |
| 中文描述： | 16位產(chǎn)品單電壓閃存MCU的家庭的RAM，EEPROM的E3展TMEMULATED，可以2.0b和J1850 BLPD |
| 文件頁數(shù)： | 336/426頁 |
| 文件大小： | 3831K |
| 代理商： | ST92124JV9Q6 |
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336/426
CONTROLLER AREA NETWORK (bxCAN)
CONTROLLER AREA NETWORK
(Cont’d)
10.10.5.5 Message Storage
The interface between the software and the hard-
ware for the CAN messages is implemented by
means of mailboxes. A mailbox contains all infor-
mation related to a message; identifier, data, con-
trol, status and time stamp information.
Transmit Mailbox
The software sets up the message to be transmit-
ted in an empty transmit mailbox. The status of the
transmission is indicated by hardware in the
MCSR register.
Transmit Mailbox Mapping
Receive Mailbox
When a message has been received, it is available
to the software in the FIFO output mailbox. Once
the software has handled the message (e.g. read
it) the software must release the FIFO output mail-
box by means of the RFOM bit in the CRFR regis-
ter to make the next incoming message available.
The filter match index is stored in the MFMI regis-
ter. The 16-bit time stamp value is stored in the
MTSR[0:1] registers.
Receive Mailbox Mapping
Offset to Transmit
Mailbox base ad-
dress (bytes)
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
Register Name
MCSR
MDLC
MIDR0
MIDR1
MIDR2
MIDR3
MDAR0
MDAR1
MDAR2
MDAR3
MDAR4
MDAR5
MDAR6
MDAR7
MTSR0
MTSR1
Offset to Receive
Mailbox base ad-
dress (bytes)
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
Register Name
MFMI
MDLC
MIDR0
MIDR1
MIDR2
MIDR3
MDAR0
MDAR1
MDAR2
MDAR3
MDAR4
MDAR5
MDAR6
MDAR7
MTSR0
MTSR1
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