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參數(shù)資料
| 型號： | ST92124DR2QC |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | CAP .0068UF 50V UF(B) FILM SMD |
| 中文描述： | 16位產(chǎn)品單電壓閃存MCU的家庭的RAM，EEPROM的E3展TMEMULATED，可以2.0b和J1850 BLPD |
| 文件頁數(shù)： | 119/426頁 |
| 文件大?。?/td> | 3831K |
| 代理商： | ST92124DR2QC |
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ST92F124/F150/F250 - INTERRUPTS
WAKE-UP / INTERRUPT LINES MANAGEMENT UNIT
(Cont’d)
WAKE-UP
TRIGGER
REGISTER
(
WUTRH)
R252
-
Read/Write
Register Page: 57
Reset Value: 0000 0000 (00h)
HIGH
Bit 7:0 =
WUT[15:8]:
Wake-Up Trigger Polarity
Bits
These bits are set and cleared by software.
0: The corresponding WUPx pending bit will be set
on the falling edge of the input wake-up line .
1: The corresponding WUPx pending bit will be set
on the rising edge of the input wake-up line.
WAKE-UP TRIGGER REGISTER LOW
(
WUTRL)
R253
-
Read/Write
Register Page: 57
Reset Value: 0000 0000 (00h)
Bit 7:0 =
WUT[7:0]:
Wake-Up Trigger Polarity Bits
These bits are set and cleared by software.
0: The corresponding WUPx pending bit will be set
on the falling edge of the input wake-up line.
1: The corresponding WUPx pending bit will be set
on the rising edge of the input wake-up line.
WARNING
1. As the external wake-up lines are edge trig-
gered, no glitches must be generated on these
lines.
2. If either a rising or a falling edge on the external
wake-up lines occurs while writing the
WUTRLH or WUTRL registers, the pending bit
will not be set.
WAKE-UP PENDING REGISTER HIGH
(
WUPRH)
R254
-
Read/Write
Register Page: 57
Reset Value: 0000 0000 (00h)
Bit 7:0 =
WUP[15:8]:
Wake-Up Pending Bits
These bits are set by hardware on occurrence of
the trigger event on the corresponding wake-up
line. They must be cleared by software. They can
be set by software to implement a software inter-
rupt.
0: No Wake-up Trigger event occurred
1: Wake-up Trigger event occured
WAKE-UP PENDING REGISTER LOW
(
WUPRL)
R255
-
Read/Write
Register Page: 57
Reset Value: 0000 0000 (00h)
Bit 7:0 =
WUP[7:0]:
Wake-Up Pending Bits
These bits are set by hardware on occurrence of
the trigger event on the corresponding wake-up
line. They must be cleared by software. They can
be set by software to implement a software inter-
rupt.
0: No Wake-up Trigger event occurred
1: Wake-up Trigger event occured
Note:
To avoid losing a trigger event while clear-
ing the pending bits,
it is recommended
to use
read-modify-write
instructions
BAND) to clear them.
(AND,
BRES,
5.12.6 Important Note On WUIMU
Refer to
Section 13.1.2 on page 408
.
7
0
WUT15 WUT14 WUT13 WUT12 WUT11 WUT10
WUT9
WUT8
7
0
WUT7
WUT6
WUT5
WUT4
WUT3
WUT2
WUT1
WUT0
7
0
WUP15 WUP14 WUP13 WUP12 WUP11 WUP10
WUP9
WUP8
7
0
WUP7
WUP6
WUP5
WUP4
WUP3
WUP2
WUP1
WUP0
9
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