參數(shù)資料
型號(hào)： ST72F324BJ2T5
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP44
封裝： 10 X 10 MM, LQFP-44
文件頁(yè)數(shù)： 6/167頁(yè)
文件大?。?/td> 2651K
代理商： ST72F324BJ2T5
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ST72323 ST72323L
On-chip peripherals
Changing the conversion channel
The application can change channels during conversion. When software modifies the
CH[3:0] bits in the ADCCSR register, the current conversion is stopped, the EOC bit is
cleared, and the A/D converter starts converting the newly selected channel.
9.5.4
Low-power modes
Note that the A/D converter may be disabled by resetting the ADON bit. This feature allows
reduced power consumption when no conversion is needed.
9.5.5
Interrupts
None.
9.5.6
Register description
Control/status register (ADCCSR)
Reset value: 0000 0000 (00h)
R
Bit 7 = EOC End of Conversion
This bit is set by hardware. It is cleared by hardware when software reads the ADCDRH
register or writes to any bit of the ADCCSR register.
0: Conversion is not complete
1: Conversion complete
Bit 6 = SPEED ADC clock selection
This bit is set and cleared by software. It is used together with the MAX_SPEED bit to
select the ADC frequency. Refer to Table 49
Bit 5 = ADON A/D Converter on
This bit is set and cleared by software.
0: Disable ADC and stop conversion
1: Enable ADC and start conversion
Table 48.
Low-power modes
Mode
Description
Wait
No effect on A/D converter
Halt
A/D Converter disabled.
After wakeup from Halt mode, the A/D converter requires a stabilization time tSTAB (see
Electrical Characteristics) before accurate conversions can be performed.
7
0
EOC
SPEED
ADON
MAX_SPEED
CH3
CH2
CH1
CH0
Read only
Read/write
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PDF描述
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