參數(shù)資料
型號: ST72F321BAR7TARE
廠商: STMICROELECTRONICS
元件分類: 微控制器/微處理器
英文描述: 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP64
封裝: 10 X 10 MM, LQFP-64
文件頁數(shù): 84/247頁
文件大?。?/td> 4195K
代理商: ST72F321BAR7TARE
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I2C bus interface (I2C)
ST72321Bxxx-Auto
174/247
16.7.5
I2C data register (DR)
16.7.6
I2C own address register (OAR1)
6:0
CC[6:0]
7-bit clock divider
These bits select the speed of the bus (fSCL) depending on the I
2C mode. They are
not cleared when the interface is disabled (PE = 0).
Refer to the Electrical characteristics chapter for the table of values.
Note: The programmed fSCL assumes no load on SCL and SDA lines.
Table 85.
CCR register description (continued)
Bit
Name
Function
DR
Reset value: 0000 0000 (00h)
7
654
32
10
D[7:0]
RW
Table 86.
DR register description
Bit
Name
Function
7:0
D[7:0]
8-bit Data Register
These bits contain the byte to be received or transmitted on the bus.
Transmitter mode: Byte transmission start automatically when the software writes
in the DR register.
Receiver mode: The first data byte is received automatically in the DR register
using the least significant bit of the address.
Then, the following data bytes are received one by one after reading the DR
register.
OAR1
Reset value: 0000 0000 (00h)
7
654
32
10
ADD7
ADD6
ADD5
ADD4
ADD3
ADD2
ADD1
ADD0
RW
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PDF描述
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