參數(shù)資料
型號(hào)： ST72321BAR7T6
廠商： STMICROELECTRONICS
元件分類(lèi)： 微控制器/微處理器
英文描述： MICROCONTROLLER, QFP64
封裝： 10 X 10 MM, ROHS COMPLIANT, LQFP-64
文件頁(yè)數(shù)： 63/187頁(yè)
文件大?。?/td> 3071K
代理商： ST72321BAR7T6
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ST72321BRx, ST72321BARx ST72321BJx, ST72321BKx
155/187
12.8 I/O PORT PIN CHARACTERISTICS
12.8.1 General Characteristics
Subject to general operating conditions for VDD, fOSC, and TA unless otherwise specified.
Figure 78. Unused I/Os configured as input
Figure 79. Typical IPU vs. VDD with VIN=VSS
Notes:
1. Data based on characterization results, not tested in production.
2. Hysteresis voltage between Schmitt trigger switching levels. Based on characterization results, not tested.
3. When the current limitation is not possible, the VIN maximum must be respected, otherwise refer to IINJ(PIN) specifica-
tion. A positive injection is induced by VIN>VDD while a negative injection is induced by VIN<VSS. Refer to section 12.2.2
on page 139 for more details.
4. Configuration not recommended, all unused pins must be kept at a fixed voltage: using the output mode of the I/O for
example and leaving the I/O unconnected on the board or an external pull-up or pull-down resistor (see Figure 78). Static
peak current value taken at a fixed VIN value, based on design simulation and technology characteristics, not tested in
production. This value depends on VDD and temperature values.
5. The RPU pull-up equivalent resistor is based on a resistive transistor (corresponding IPU current characteristics de-
scribed in Figure 79).
6. To generate an external interrupt, a minimum pulse width has to be applied on an I/O port pin configured as an external
interrupt source.
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VIL
Input low level voltage 1)
CMOS ports
0.3xVDD
V
VIH
Input high level voltage 1)
0.7xVDD
Vhys
Schmitt trigger voltage hysteresis 2)
0.7
IINJ(PIN)
3)
Injected Current on PC6 (Flash de-
vices only)
VDD=5V
0+4
mA
Injected Current on an I/O pin
± 4
ΣIINJ(PIN)3)
Total injected current (sum of all I/O
and control pins)
± 25
IL
Input leakage current
VSS≤VIN ≤VDD
±1
μA
IS
Static current consumption
Floating input mode 4)
400
RPU
Weak pull-up equivalent resistor 5)
VIN=VSS
VDD=5V
50
120
250
k
Ω
CIO
I/O pin capacitance
5
pF
tf(IO)out
Output high to low level fall time 1)
CL=50pF
Between 10% and 90%
25
ns
tr(IO)out
Output low to high level rise time 1)
25
tw(IT)in
External interrupt pulse time 6)
1tCPU
10k
Ω
ST7XXX
10k
Ω
UNUSED I/O PORT
ST7XXX
VDD
Note: I/O can be left unconnected if it is configured as output
greater EMC robustness and lower cost.
(0 or 1) by the software. This has the advantage of
UNUSED I/O PORT
0
10
20
30
40
50
60
70
80
90
22.5
33.5
4
4.5
55.5
6
Vdd(V)
Ipu(
u
A
)
Ta=140°C
Ta=95°C
Ta=25°C
Ta=-45°C
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PDF描述
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