參數(shù)資料
型號： SN74LV595ADBR
廠商： Texas Instruments, Inc.
元件分類： 通用總線功能
英文描述： 8-BIT SHIFT REGISTERS WITH 3-STATE OUTPUT REGISTERS
中文描述： 8位移位寄存器3態(tài)輸出寄存器
文件頁數(shù)： 7/20頁
文件大小： 492K
代理商： SN74LV595ADBR
SCLS414N APRIL 1998 REVISED APRIL 2005
7
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
electrical characteristics over recommended operating free-air temperature range (unless
otherwise noted)
PARAMETER
TEST CONDITIONS
VCC
SN54LV595A
MIN
VCC0.1
2
SN74LV595A
MIN
VCC0.1
2
UNIT
TYP
MAX
TYP
MAX
IOH = 50
μ
A
IOH = 2 mA
IOH = 6 mA
IOH = 8 mA
IOH = 12 mA
IOH = 16 mA
IOL = 50
μ
A
IOL = 2 mA
IOL = 6 mA
IOL = 8 mA
IOL = 12 mA
IOL = 16 mA
VI = 5.5 V or GND
VO = VCC or GND,
VI = VCC or GND,
VI or VO = 0 to 5.5 V
VI = VCC or GND
2 V to 5.5 V
2.3 V
VOH
QH
′
QAQH
QH
′
QAQH
3 V
2.48
2.48
V
2.48
2.48
4.5 V
3.8
3.8
3.8
3.8
2 V to 5.5 V
0.1
0.1
2.3 V
0.4
0.4
VOL
QH
′
QAQH
QH
′
QAQH
3 V
0.44
0.44
V
0.44
0.44
4.5 V
0.55
0.55
0.55
±
1
±
5
20
0.55
±
1
±
5
20
II
IOZ
ICC
Ioff
Ci
0 to 5.5 V
μ
A
μ
A
μ
A
μ
A
pF
QAQH
IO = 0
5.5 V
5.5 V
0
5
5
3.3 V
3.5
3.5
timing requirements over recommended operating free-air temperature range, V
CC
= 2.5 V
±
0.2 V
(unless otherwise noted) (see Figure 1)
TA = 25
°
C
MIN
7
SN54LV595A
MIN
7.5
SN74LV595A
MIN
7.5
UNIT
MAX
MAX
MAX
SRCLK high or low
tw
Pulse duration
RCLK high or low
7
7.5
7.5
ns
SRCLR low
SER before SRCLK
↑
SRCLK
↑
before RCLK
↑
SRCLR low before RCLK
↑
SRCLR high (inactive) before SRCLK
↑
SER after SRCLK
↑
6
6.5
6.5
5.5
5.5
5.5
tsu
Setup time
8
9
9
ns
8.5
9.5
9.5
4
4
4
th
Hold time
1.5
1.5
1.5
ns
This setup time allows the storage register to receive stable data from the shift register. The clocks can be tied together, in which case the shift
register is one clock pulse ahead of the storage register.
(
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PDF描述
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SN74LV595APWG4 8-BIT SHIFT REGISTERS WITH 3-STATE OUTPUT REGISTERS
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