參數(shù)資料
型號： SI91872DMP-18-T1
廠商： Vishay Intertechnology,Inc.
元件分類： 基準(zhǔn)電壓源/電流源
英文描述： 300-mA Low-Noise LDO Regulator With Error Flag and Discharge Option
中文描述： 300 - mA的低噪音LDO調(diào)節(jié)器錯誤國旗和放電期權(quán)
文件頁數(shù)： 4/9頁
文件大小： 115K
代理商： SI91872DMP-18-T1
Si91872
Vishay Siliconix
www.vishay.com
4
Document Number: 72013
S-51147—Rev. F, 20-Jun-05
PIN CONFIGURATION: MLP33-5
MLP33-5 PowerPAK
1
2
1
2
3
4
5
3
4
5
SD
ERROR
V
IN
V
OUT
GND
GND
GND
GND
Top View
Bottom View
PIN DESCRIPTION
Pin Number
Name
Function
1
SD
By applying less than 0.4 V to this pin, the device will be turned off. Connect this pin to V
IN
if unused
The open drain output is an error flag output which goes low when V
OUT
drops 4% below its nominal voltage.
2
ERROR
3
V
IN
Input supply pin. Bypass this pin with a 1- F ceramic or tantalum capacitor to ground
4
V
OUT
Output voltage. Connect C
OUT
between this pin and ground.
5
GND
Ground pin. For better thermal capability, directly connected to large ground plane
ORDERING INFORMATION
Standard
Part Number
Lead (Pb)-Free
Part Number
Marking
Voltage
Temp.
Range
Pkg.
Si91872DMP-12-T1
Si91872DMP-12-E3
7212
1.2
Si91872DMP-18-T1
Si91872DMP-18-E3
7218
1.8
Si91872DMP-25-T1
Si91872DMP-25-E3
7225
2.5
Si91872DMP-26-T1
Si91872DMP-26-E3
7226
2.6
40 to 85 C
MLP33 5
MLP33-5
Si91872DMP-28-T1
Si91872DMP-28-E3
7228
2.8
Si91872DMP-30-T1
Si91872DMP-30-E3
7230
3.0
Si91872DMP-33-T1
Si91872DMP-33-E3
7233
3.3
Si91872DMP-50-T1
Si91872DMP-50-E3
7250
5.0
相關(guān)PDF資料
PDF描述
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SI91872DMP-26-E3 300-mA Low-Noise LDO Regulator With Error Flag and Discharge Option
SI91872DMP-26-T1 BiCMOS FCT Interface Logic Octal Non-Inverting Buffers/Line Drivers with 3-State Outputs 20-SOIC 0 to 70
SI91872DMP-28-E3 300-mA Low-Noise LDO Regulator With Error Flag and Discharge Option
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