參數(shù)資料
型號: SI5369C-C-GQ
廠商: Silicon Laboratories Inc
文件頁數(shù): 18/84頁
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描述: IC CLK MULT JITTER ATTEN 100TQFP
標(biāo)準(zhǔn)包裝: 90
系列: DSPLL®
類型: *
PLL:
輸入: LVCMOS
輸出: CML,CMOS,LVDS,LVPECL
電路數(shù): 1
比率 - 輸入:輸出: 4:5
差分 - 輸入:輸出: 是/是
頻率 - 最大: 346MHz
除法器/乘法器: 是/是
電源電壓: 1.71 V ~ 3.63 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 100-TQFP
供應(yīng)商設(shè)備封裝: 100-TQFP(14x14)
包裝: 托盤
Si5369
Rev. 1.0
25
5. Register Descriptions
Reset value = 0001 0100
Register 0.
Bit
D7
D6
D5
D4D3D2
D1
D0
Name
FREE_RUN
CKOUT_ALWAYS_ON
BYPASS_REG
Type
R
R/W
R
R/W
R
Bit
Name
Function
7
Reserved
6
FREE_RUN
Free Run.
Internal to the device, route XA/XB to CKIN2. This allows the device to lock to its
external reference.
0: Disable Free Run
1: Enable
5
CKOUT_ALWAYS_ON CKOUT Always On.
This will bypass the SQ_ICAL function. Output will be available even if SQ_ICAL
is on and ICAL is not complete or successful. See Table 8.
0: Squelch output until part is calibrated (ICAL).
1: Provide an output. Note: The frequency may be significantly off until the part
is calibrated.
4:2
Reserved
1
BYPASS_REG
Bypass Register.
This bit enables or disables the PLL bypass mode. Use is only valid when the
part is in digital hold or before the first ICAL.
0: Normal operation
1: Bypass mode. Selected input clock is connected to CKOUT buffers, bypass-
ing PLL.
0
Reserved
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PDF描述
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參數(shù)描述
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Si5369D-C-GQ 功能描述:時鐘發(fā)生器及支持產(chǎn)品 LW LOOP BW AR CLK MULT/JITTER 4IN 5OUT RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
SI5369D-C-GQR 功能描述:時鐘發(fā)生器及支持產(chǎn)品 Lo Loop BW Clk Multi Jitter Attn 4In/5Out RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
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