t
參數(shù)資料
型號： SI3201-GS
廠商： Silicon Laboratories Inc
文件頁數(shù)： 46/148頁
文件大?。?/td> 0K
描述： IC LINEFEED INTRFC SI321X 16SOIC
標準包裝： 48
系列： ProSLIC®
功能： CODEC
接口： PCM，串行，SPI
電路數(shù)： 1
電源電壓： 3.13 V ~ 5.25 V
電流 - 電源： 88mA
功率（瓦特）： 800mW
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 16-SOIC（0.154"，3.90mm Width）裸露焊盤
供應(yīng)商設(shè)備封裝： 16-SOIC N
包裝： 管件
包括： BORSCHT 功能，振鈴?fù)禉z測
Si3210/Si3211
14
Rev. 1.61
Not
Recommended
fo
r N
ew
D
esi
gn
s
Figure 7. SPI Timing Diagram
SDI to SDITHRU Propagation Delay
td4
—
4
10
ns
Note: All timing is referenced to the 50% level of the waveform. Input test levels are VIH =VDDD –0.4 V, VIL =0.4 V
Table 11. Switching Characteristics—PCM Highway Serial Interface
VD = 3.13 to 5.25 V, TA = 0 to 70 °C for F-Grade, –40 to 85 °C for G-Grade, CL =20pF
Parameter
Symbol
Test
Conditions
Min 1
Typ 1
Max 1
Units
PCLK Frequency
1/tc
—
0.256
0.512
1.024
2.048
4.096
8.192
—
MHz
PCLK Duty Cycle Tolerance
tdty
40
50
60
%
PCLK-to-FSYNC Jitter Tolerance
tjitter
–120
—
120
ns
Rise Time, PCLK
tr
——
25
ns
Fall Time, PCLK
tf
——
25
ns
Delay Time, PCLK Rise to DTX Active
td1
——
20
ns
Delay Time, PCLK Rise to DTX
Transition
td2
——
20
ns
Delay Time, PCLK Rise to DTX Tri-state3
td3
——
20
ns
Setup Time, FSYNC to PCLK Fall
tsu1
25
—
ns
Hold Time, FSYNC to PCLK Fall
th1
20
—
ns
Table 10. Switching Characteristics (SPI)
VDDA =VDDA = 3.13 to 5.25 V, TA = 0 to 70 °C for F-Grade, –40 to 85 °C for G-Grade, CL =20pF
SCLK
CS
SDI
t
h1
t
d3
SDO
t
d1
t
d2
t
su1
t
r
t
r
t
c
t
su2
t
h2
t
cs
t
thru
相關(guān)PDF資料
PDF描述
SI3202-G-FS IC LINEFEED INTRFC 125V 16SOIC
SI3200-G-FS IC SLIC/CODEC 100V LINE 16SOIC
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