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參數(shù)資料
| 型號： | SDA5250-2 |
| 廠商： | SIEMENS A G |
| 元件分類： | 圖文 |
| 英文描述： | ICs for Consumer Electronics |
| 中文描述： | TELETEXT DECODER, PQCC84 |
| 文件頁數(shù)： | 84/143頁 |
| 文件大?。?/td> | 1050K |
| 代理商： | SDA5250-2 |
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SDA 525x
Semiconductor Group
84
1998-04-08
Timer/Counter Control Register
Timer 0/1 Mode Register
Default after reset: 00
H
(MSB)
TF1
TCON
SFR-Address 88
H
(LSB)
IT0
TR1
TF0
TR0
IE1
IT1
IE0
TF1
Timer 1 overflow flag. Set by hardware on timer/counter
overflow. Cleared by hardware when processor vectors to
interrupt routine.
TR1
Timer 1 run control bit. Set/cleared by software to turn
timer/counter on/off.
TF0
Timer 0 overflow flag. Set by hardware on timer/counter
overflow. Cleared by hardware when processor vectors to
interrupt routine.
TR0
Timer 0 run control bit. Set/cleared by software to turn
timer/counter on/off.
IE1
Interrupt 1 edge flag. Set by hardware when external interrupt
edge detected. Cleared when interrupt processed.
IT1
Interrupt 1 type control bit. Set/cleared by software to specify
edge/low level triggered external interrupts.
IE0
Interrupt 0 edge flag. Set by hardware when external interrupt
edge detected. Cleared when interrupt processed.
IT0
Interrupt 0 type control bit. Set/cleared by software to specify
edge/low level triggered external interrupts.
相關(guān)PDF資料 |
PDF描述 |
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