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參數(shù)資料
| 型號： | SAB-C165-LF 3V HA |
| 廠商： | Infineon Technologies |
| 文件頁數(shù)： | 68/77頁 |
| 文件大小： | 0K |
| 描述： | IC MCU 16BIT TQFP-100-3 |
| 標(biāo)準(zhǔn)包裝： | 1,400 |
| 系列： | C16xx |
| 核心處理器： | C166 |
| 芯體尺寸： | 16-位 |
| 速度： | 20MHz |
| 連通性： | EBI/EMI，SPI，UART/USART |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 77 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 振蕩器型： | 外部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | B165LF3VHAXT C165LF3VHABXUMA1 SABC165LF3VHAXT SP000011597 |
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C165
Data Sheet
66
V2.0, 2000-12
AC Characteristics
CLKOUT and READY (Reduced Supply Voltage)
(Operating Conditions apply)
Parameter
Symbol
Max. CPU Clock
= 20 MHz
Variable CPU Clock
1 / 2TCL = 1 to 20 MHz
Unit
min.
max.
min.
max.
CLKOUT cycle time
t29 CC 50
50
2TCL
ns
CLKOUT high time
t30 CC 15
–
TCL - 10
–
ns
CLKOUT low time
t31 CC 13
–
TCL - 12
–
ns
CLKOUT rise time
t32 CC –
12
–
12
ns
CLKOUT fall time
t33 CC –
8
–8ns
CLKOUT rising edge to
ALE falling edge
t34 CC 0 + tA
8 +
tA
0 +
tA
8 +
tA
ns
Synchronous READY
setup time to CLKOUT
t35 SR 18
–
18
–
ns
Synchronous READY
hold time after CLKOUT
t36 SR 4
–
4–ns
Asynchronous READY
low time
t37 SR 68
–
2TCL +
t58 –ns
Asynchronous READY
setup time1)
1) These timings are given for test purposes only, in order to assure recognition at a specific clock edge.
t58 SR 18
–
18
–
ns
Asynchronous READY
hold time1)
t59 SR 4
–
4–ns
Async. READY hold time
after RD, WR high
(Demultiplexed Bus)2)
2) Demultiplexed bus is the worst case. For multiplexed bus 2TCL are to be added to the maximum values. This
adds even more time for deactivating READY.
The 2
tA and tC refer to the next following bus cycle, tF refers to the current bus cycle.
The maximum limit for
t60 must be fulfilled if the next following bus cycle is READY controlled.
t60 SR 0
0
+ 2
tA +
tC
+
tF
0TCL – 25
+ 2
tA + tC
+
tF
ns
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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