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參數(shù)資料
| 型號： | S9S12XS256J0CAL |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 526/738頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 256K FLASH 112-LQFP |
| 標準包裝： | 300 |
| 系列： | HCS12X |
| 核心處理器： | HCS12X |
| 芯體尺寸： | 16-位 |
| 速度： | 40MHz |
| 連通性： | CAN，SCI，SPI |
| 外圍設(shè)備： | LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 91 |
| 程序存儲器容量： | 256KB（256K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 12K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.72 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 16x12b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 112-LQFP |
| 包裝： | 托盤 |
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128 KByte Flash Module (S12XFTMR128K1V1)
S12XS Family Reference Manual, Rev. 1.13
572
Freescale Semiconductor
All assigned bits in the FERCNFG register are readable and writable.
19.3.2.7
Flash Status Register (FSTAT)
The FSTAT register reports the operational status of the Flash module.
CCIF, ACCERR, and FPVIOL bits are readable and writable, MGBUSY and MGSTAT bits are readable
but not writable, while remaining bits read 0 and are not writable.
Offset Module Base + 0x0005
76543210
R
0
DFDIE
SFDIE
W
Reset
00000000
= Unimplemented or Reserved
Figure 19-10. Flash Error Conguration Register (FERCNFG)
Table 19-14. FERCNFG Field Descriptions
Field
Description
1
DFDIE
Double Bit Fault Detect Interrupt Enable — The DFDIE bit controls interrupt generation when a double bit fault
is detected during a Flash block read operation.
0 DFDIF interrupt disabled
1 An interrupt will be requested whenever the DFDIF ag is set (see Section 19.3.2.8)
0
SFDIE
Single Bit Fault Detect Interrupt Enable — The SFDIE bit controls interrupt generation when a single bit fault
is detected during a Flash block read operation.
0 SFDIF interrupt disabled whenever the SFDIF ag is set (see Section 19.3.2.8)
1 An interrupt will be requested whenever the SFDIF ag is set (see Section 19.3.2.8)
Offset Module Base + 0x0006
76543210
R
CCIF
0
ACCERR
FPVIOL
MGBUSY
RSVD
MGSTAT[1:0]
W
Reset
100000
01
1 Reset value can deviate from the value shown if a double bit fault is detected during the reset sequence (see Section 19.6).
01
= Unimplemented or Reserved
Figure 19-11. Flash Status Register (FSTAT)
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