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參數(shù)資料
| 型號： | S9S08AW16AE2CLM |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP32 |
| 封裝： | 7 X 7 MM, 1.40 MM HEIGHT, 0.80 MM PITCH, MS-026BBA, LQFP-32 |
| 文件頁數(shù)： | 171/338頁 |
| 文件大?。?/td> | 3467K |
| 代理商： | S9S08AW16AE2CLM |
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Chapter 14 Analog-to-Digital Converter (S08ADC10V1)
MC9S08AC16 Series Data Sheet, Rev. 4
252
Freescale Semiconductor
NOTE
Selecting the internal bandgap channel requires BGBE =1 in SPMSC1 see
(SPMSC1).” For value of bandgap voltage reference see Section A.6, “DC
14.2.1
Alternate Clock
The ADC module is capable of performing conversions using the MCU bus clock, the bus clock divided
by two, the local asynchronous clock (ADACK) within the module, or the alternate clock, ALTCLK. The
alternate clock for the MC9S08AC16 Series MCU devices is the external reference clock (ICGERCLK)
from the internal clock generator (ICG) module.
Because ICGERCLK is active only while an external clock source is enabled, the ICG must be congured
for either FBE or FEE mode (CLKS1 = 1). ICGERCLK must run at a frequency such that the ADC
conversion clock (ADCK) runs at a frequency within its specied range (fADCK) after being divided down
from the ALTCLK input as determined by the ADIV bits. For example, if the ADIV bits are set up to divide
by four, then the minimum frequency for ALTCLK (ICGERCLK) is four times the minimum value for
fADCK and the maximum frequency is four times the maximum value for fADCK. Because of the minimum
frequency requirement, when an oscillator circuit is used it must be congured for high range operation
(RANGE = 1).
ALTCLK is active while the MCU is in wait mode provided the conditions described above are met. This
allows ALTCLK to be used as the conversion clock source for the ADC while the MCU is in wait mode.
ALTCLK cannot be used as the ADC conversion clock source while the MCU is in stop3.
14.2.2
Hardware Trigger
The ADC hardware trigger, ADHWT, is output from the real time interrupt (RTI) counter. The RTI counter
can be clocked by either ICGERCLK or a nominal 1 kHz clock source within the RTI block. The 1-kHz
clock source can be used with the MCU in run, wait, or stop3. With the ICG congured for either FBE or
FEE mode, ICGERCLK can be used with the MCU in run or wait.
The period of the RTI is determined by the input clock frequency and the RTIS bits. When the ADC
hardware trigger is enabled, a conversion is initiated upon an RTI counter overow. The RTI counter is a
free running counter that generates an overow at the RTI rate determined by the RTIS bits.
14.2.2.1
Analog Pin Enables
The ADC on MC9S08AC16 Series contains only two analog pin enable registers, APCTL1 and APCTL2.
14.2.2.2
Low-Power Mode Operation
The ADC is capable of running in stop3 mode but requires LVDSE and LVDE in SPMSC1 to be set.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MC9S08AC48MFGE | 8-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP44 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| S9S08AW16AE2VXX | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-Bit HCS08 Central Processor Unit (CPU) |
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| S9S08AW16E5CFGE | 制造商:Freescale Semiconductor 功能描述:MCU 8BIT HCS08 CISC 16KB FLASH 3.3V/5V 44LQFP - Bulk |
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