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參數(shù)資料
| 型號(hào)： | S71WS512ND0BFWY63 |
| 廠商： | SPANSION LLC |
| 元件分類： | 存儲(chǔ)器 |
| 英文描述： | Stacked Multi-Chip Product (MCP) |
| 中文描述： | SPECIALTY MEMORY CIRCUIT, PBGA84 |
| 封裝： | 12 X 9 MM, 1.40 MM HEIGHT, LEAD FREE, FBGA-84 |
| 文件頁(yè)數(shù)： | 104/188頁(yè) |
| 文件大?。?/td> | 2252K |
| 代理商： | S71WS512ND0BFWY63 |
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102
S71WS-Nx0 Based MCPs
S71WS-N_01_A4 September 15, 2005
A d v a n c e I n f o r m a t i o n
17 Pin Description
Pin Name
CLK
ADV#
Function
Clock
Address Valid
Type
Description
Input
Commands, Data are referenced to CLK
Address valid from ADV# falling edge to ADV# rising edge
MRS# enables Mode Register to be set.
Addresses are loaded as Mode setting is Low
CS# enables the chip to start operating when Low
CS# disables the chip and puts it into standby mode when High
CS# stops burst operating.during burst operation when High
OE# enables the chip to output the data when Low
WE# enables the chip to start writing the data when Low
MRS#
Mode Register set
CS#
Chip Select
OE#
WE#
LB#
UB#
Output Enable
Write Enable
Lower Byte (I/O
0~ 7
)
Upper Byte (I/O
8~ 15
)
UB# (or LB#) enables upper byte (or lower byte) to be
operated when Low
A0-A21
Address 0 ~ Address 21
Valid addresses input when ADV# is low.
Mode setting inputs during MRS# Low.
Depending on UB# or LB# status, word (16-bit,
UB#, and LB# low) data, upper byte (8-bit, UB#
low & LB# high) data or lower byte (8-bit, LB# low,
and UB# high) data is loaded
Power supply for cells and circuits except for I/O buffer circuits
Power supply for I/O buffer circuits
Ground for cells and circuits except for I/O buffer circuits
Ground for I/O buffer circuits
WAIT# indicates that output data is invalid when Low
—
I/O0-I/O15
Data Inputs / Outputs
Input/Output
V
CC
V
CCQ
V
SS
V
SSQ
WAIT#
DNU
Core Voltage Source
I/O Voltage Source
Core Ground Source
I/O Ground Source
Valid Data Indicator
Do Not Use
Power
Power
GND
GND
Output
—
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| S71WS512ND0BFWYJ2 | 制造商:SPANSION 制造商全稱:SPANSION 功能描述:Stacked Multi-Chip Product (MCP) |
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