參數(shù)資料
型號(hào)： S3S12P128J0VQK
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 16-BIT, MROM, 1.05 MHz, MICROCONTROLLER, PQFP80
封裝： 14 X 14 MM, 2.20 MM HEIGHT, 0.65 MM PITCH, QFP-80
文件頁(yè)數(shù)： 321/566頁(yè)
文件大小： 7046K
代理商： S3S12P128J0VQK
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Serial Communication Interface (S12SCIV5)
S12P-Family Reference Manual, Rev. 1.13
388
Freescale Semiconductor
To determine the value of a data bit and to detect noise, recovery logic takes samples at RT8, RT9, and
RT10. Table 11-18 summarizes the results of the data bit samples.
NOTE
The RT8, RT9, and RT10 samples do not affect start bit verication. If any
or all of the RT8, RT9, and RT10 start bit samples are logic 1s following a
successful start bit verication, the noise ag (NF) is set and the receiver
assumes that the bit is a start bit (logic 0).
To verify a stop bit and to detect noise, recovery logic takes samples at RT8, RT9, and RT10. Table 11-19
summarizes the results of the stop bit samples.
In Figure 11-22 the verication samples RT3 and RT5 determine that the rst low detected was noise and
not the beginning of a start bit. The RT clock is reset and the start bit search begins again. The noise ag
is not set because the noise occurred before the start bit was found.
Table 11-18. Data Bit Recovery
RT8, RT9, and RT10 Samples
Data Bit Determination
Noise Flag
000
0
001
0
1
010
0
1
011
1
100
0
1
101
1
110
1
111
1
0
Table 11-19. Stop Bit Recovery
RT8, RT9, and RT10 Samples
Framing Error Flag
Noise Flag
000
1
0
001
1
010
1
011
0
1
100
1
101
0
1
110
0
1
111
0
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PDF描述
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