參數(shù)資料
型號： S3P863A-QZ
元件分類： 微控制器/微處理器
英文描述： 8-BIT, OTPROM, 12 MHz, MICROCONTROLLER, PQFP44
封裝： 10 X 10 MM, QFP-44
文件頁數(shù)： 216/397頁
文件大?。?/td> 1373K
代理商： S3P863A-QZ
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SYNC PROCESSOR
S3C8639/C863A/P863A/C8647/F8647
16-24
JR
Z,ChkMuteTime
ChkHVPrtn
RET
;
ChkMuteTime
TM
Mute_FGR,#01<<ChkSyncStus_FG
;Checking sync status every Vsync
;signal event
JP
Z,VMuteRtn
TM
Mute_FGR,#01<<MuteWaiting_FG
;Already previous mute-release step ?
JP
NZ,MuteRelease
TM
SyncP_FGR0,#01<<HstblFreq_FG
;Stable Hsync input ?
JR
NZ,ChkStblVsync
OR
Mute_FGR,#01<<ChkSyncStus_FG
RET
;
ChkStblVsync
TM
SyncP_FGR0,#01<<VstblFreq_FG
;Stable Vsync input ?
JR
NZ,NormalSyncOut
OR
Mute_FGR,#01<<ChkSyncStus_FG
RET
;
NormalSyncOut
CALL
PosiPolOut
;Adjust polarity to positive
CALL
PolaUpDate
;Polarity data update
LD
SYNCON2,#10110000B
;Normal sync operation
AND
Mute_FGR,#0FFh-(01<<PsyncOut_FG)
OR
SyncP_FGR0,#01<<NormSync_FG
;Re-start polarity checking
;
LoadDAC
CALL
UpdateHDuty
;Adjust Hsync duty value in KB2511
CALL
AdjModeSize
;Adjust mode size according to Hsync freq. range
CALL
B_PlusOut
;Adjust B+ reference value in KB2511
CALL
S_Correct
;Adjust S-correction port
;
OR
EepRom_FGR,#01<<EepDataRd_FG
;Load PWM data
;(processing in 'MAIN' routine)
OR
Mute_FGR,#01<<MuteWaiting_FG
;Start time checking for mute extension
AND
Mute_FGR,#0FFh-(01<<ChkSyncStus_FG)
TM
Mute_FGR,#01<<PwrOnWait_FG
JR
NZ,MuteDelay
CLR
M10mSR
;2sec
RET
MuteDelay
OR
Mute_FGR,#01<<NormMwait_FG
;Load image data -> 350ms delay
; -> Mute release
CLR
M10mSR
RET
;
MuteRelease
AND
Mute_FGR,#0FFh-(01<<ChkSyncStus_FG)
AND
Mute_FGR,#0FFh-(01<<MuteWaiting_FG)
AND
Mute_FGR,#0FFh-(01<<Vmute_FG)
OR
Mute_FGR,#01<<MuteRelse_FG
OR
P0,#01<<Muteport
;P0.7 <- 1 : mute port release
;
LD
R14,#PSubA_SBnBr
;Off soft blanking(bit7 <- 0, KA2504)
LD
R15,#00h
;R14= device(KA2504) sub-address,
;R15= control data
CALL
Preamp_RGB_Drv
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