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S3C8639/C863A/P863A/C8647/F8647
DDC MODULE
17-17
READ-WRITE OPERATIONS
When operating in transmitter mode, the IIC-bus interface interrupt routine waits for the master (the
KS88C6332/C6348) to write a data byte into the IIC-bus data shift register (DDSR). To do this, it holds the SCL
line Low prior to transmission.
In receive mode, the IIC-bus interface waits for the master to read the byte from the IIC-bus data shift register
(DDSR). It does this by holding the SCL line Low following the complete reception of a data byte.
BUS ARBITRATION PROCEDURES
Arbitration takes place on the SDA line to prevent contention on the bus between two masters. If a master with a
SDA High level detects another master with an SDA active Low level, it will not initiate a data transfer because
the current level on the bus does not correspond to its own. The master which loses the arbitration can generate
SCL pulses only until the end of the last-transmitted data byte. The arbitration procedure can continue while data
continues to be transferred over the bus.
The first stage of arbitration is the comparison of address bits. If a master loses the arbitration during the
addressing stage of a data transfer, it is possible that the master which won the arbitration is attempting to
address the master which lost. In this case, the losing master must immediately switch to slave receiver mode.
ABORT CONDITIONS
If a slave receiver does not acknowledge the slave address, it must hold the level of the SDA line High. This
signals the master to generate a stop condition and to abort the transfer.
If a master receiver is involved in the aborted transfer, it must also signal the end of the slave transmit operation.
It does this by not generating an ACK after the last data byte received from the slave. The slave transmitter must
then release the SDA to allow a master to generate a stop condition.
CONFIGURING THE IIC-BUS
To control the frequency of the serial clock (SCL), you program the 4-bit prescaler value in the DCCR register.
The IIC-bus interface address is stored in IIC-bus address register, DIAR0/DAR1. (By default, the IIC-bus
interface address is an unknown value.)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| S3P863A-QZ | 8-BIT, OTPROM, 12 MHz, MICROCONTROLLER, PQFP44 |
| S3P9434XX-DH | 8-BIT, OTPROM, 16 MHz, MICROCONTROLLER, PDIP16 |
| S3C9432XX-DH | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, PDIP16 |
| S3C9432XX-DI | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, PDIP18 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| S3P9014 | 制造商:SAMSUNG 制造商全稱:Samsung semiconductor 功能描述:SAM87RI family of 8-bit single-chip CMOS microcontrollers |
| S3P921F | 制造商:SAMSUNG 制造商全稱:Samsung semiconductor 功能描述:SAM88RCRI family of 8-bit single-chip CMOS microcontrollers |
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