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參數(shù)資料
| 型號： | R80C32XXX-42 |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 42 MHz, MICROCONTROLLER, CQCC44 |
| 封裝： | LCC-44 |
| 文件頁數(shù)： | 39/364頁 |
| 文件大?。?/td> | 7426K |
| 代理商： | R80C32XXX-42 |
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133
8019K–AVR–11/10
ATmega165P
The setup of the OC2A should be performed before setting the Data Direction Register for the
port pin to output. The easiest way of setting the OC2A value is to use the Force Output Com-
pare (FOC2A) strobe bit in Normal mode. The OC2A Register keeps its value even when
changing between Waveform Generation modes.
Be aware that the COM2A[1:0] bits are not double buffered together with the compare value.
Changing the COM2A[1:0] bits will take effect immediately.
16.6
Compare Match Output Unit
The Compare Output mode (COM2A[1:0]) bits have two functions. The Waveform Generator
uses the COM2A[1:0] bits for defining the Output Compare (OC2A) state at the next compare
match. Also, the COM2A[1:0] bits control the OC2A pin output source. Figure 16-4 shows a sim-
plified schematic of the logic affected by the COM2A[1:0] bit setting. The I/O Registers, I/O bits,
and I/O pins in the figure are shown in bold. Only the parts of the general I/O Port Control Regis-
ters (DDR and PORT) that are affected by the COM2A[1:0] bits are shown. When referring to the
OC2A state, the reference is for the internal OC2A Register, not the OC2A pin.
Figure 16-4. Compare Match Output Unit, Schematic
The general I/O port function is overridden by the Output Compare (OC2A) from the Waveform
Generator if either of the COM2A[1:0] bits are set. However, the OC2A pin direction (input or
output) is still controlled by the Data Direction Register (DDR) for the port pin. The Data Direc-
tion Register bit for the OC2A pin (DDR_OC2A) must be set as output before the OC2A value is
visible on the pin. The port override function is independent of the Waveform Generation mode.
The design of the Output Compare pin logic allows initialization of the OC2A state before the
output is enabled. Note that some COM2A[1:0] bit settings are reserved for certain modes of
operation. See “Register Description” on page 143.
PORT
DDR
DQ
OCnx
Pin
OCnx
DQ
Waveform
Generator
COMnx1
COMnx0
0
1
D
ATA
B
U
S
FOCnx
clk
I/O
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