參數(shù)資料
型號： R5F2L3AACNFP
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP100
封裝： 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100
文件頁數(shù)： 18/50頁
文件大?。?/td> 588K
代理商： R5F2L3AACNFP
2. Central Processing Unit (CPU)
REJ03B0293-0010 Rev.0.10
Oct 30, 2009
Page 25 of 48
R8C/L35C Group, R8C/L36C Group, R8C/L38C Group, R8C/L3AC Group
Under development Preliminary specification
Specifications in this manual are tentative and subject to change.
2.
Central Processing Unit (CPU)
Figure 2.1 shows the CPU Registers. The CPU contains 13 registers. R0, R1, R2, R3, A0, A1, and FB configure a
register bank. There are two sets of register banks.
Figure 2.1
CPU Registers
R2
b31
b15
b8b7
b0
Data registers (1)
Address registers (1)
R3
R0H (high-order of R0)
R2
R3
A0
A1
INTBH
b15
b19
b0
INTBL
FB
Frame base register (1)
The 4 high-order bits of INTB are INTBH and
the 16 low-order bits of INTB are INTBL.
Interrupt table register
b19
b0
USP
Program counter
ISP
SB
User stack pointer
Interrupt stack pointer
Static base register
PC
FLG
Flag register
Carry flag
Debug flag
Zero flag
Sign flag
Register bank select flag
Overflow flag
Interrupt enable flag
Stack pointer select flag
Reserved bit
Processor interrupt priority level
Reserved bit
C
IPL
D
Z
S
B
O
I
U
b15
b0
b15
b0
b15
b0
b8
b7
Note:
1. These registers configure a register bank.
There are two sets of register banks.
R1H (high-order of R1)
R0L (low-order of R0)
R1L (low-order of R1)
相關PDF資料
PDF描述
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