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參數(shù)資料
| 型號(hào)： | QL8150-8PUN196I |
| 廠商： | QUICKLOGIC CORP |
| 元件分類(lèi)： | FPGA |
| 英文描述： | FPGA, 640 CLBS, 188946 GATES, PBGA196 |
| 封裝： | 8 X 8 MM, 0.50 MM PITCH, LEAD FREE, TFBGA-196 |
| 文件頁(yè)數(shù)： | 13/96頁(yè) |
| 文件大?。?/td> | 1607K |
| 代理商： | QL8150-8PUN196I |
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2007 QuickLogic Corporation
Eclipse II Family Data Sheet Rev. Q
20
Figure 16: Required Power-Up Sequence When Using Power-Up Loading
To use the power-up loading function in Eclipse II, designers must ensure that V
CC begins to ramp within a
maximum of 2 ms of V
CCIO, VDED, VDED2, and VPUMP.
Vo
lta
g
e
V
CCIO
V
DED
V
DED2
V
PUMP
V
CC
Time
< 2 ms
V
CC
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| QL8150-8PUN196M | FPGA, 640 CLBS, 188946 GATES, PBGA196 |
| QLL12X16B-0CG84C | FPGA, 192 CLBS, 2000 GATES, 80 MHz, CPGA84 |
| QLL12X16B-0PF100C | FPGA, 192 CLBS, 2000 GATES, 80 MHz, PQFP100 |
| QLL12X16B-0PL68C | FPGA, 192 CLBS, 2000 GATES, 80 MHz, PQCC68 |
| QLL12X16B-0PL84C | FPGA, 192 CLBS, 2000 GATES, 80 MHz, PQCC84 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| QL8250 | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:LOW POWER FPGA COMBINING PERFORMANCE DENSITY AND EMBEDED RAM |
| QL8250-6PQN208C-5690 | 制造商:QuickLogic Corporation 功能描述: |
| QL8250-6PQN208C-5691 | 制造商:QuickLogic Corporation 功能描述: |
| QL82SD | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:10 High Speed Bus LVDS Serial Links bandwidth up to 5 Gbps |
| QL82SD-PB516 | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:10 High Speed Bus LVDS Serial Links bandwidth up to 5 Gbps |
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