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參數(shù)資料
| 型號： | QL8150-8PTN280I |
| 廠商： | QUICKLOGIC CORP |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 640 CLBS, 188946 GATES, PBGA280 |
| 封裝： | 0.80 MM PITCH, LEAD FREE, LFBGA-280 |
| 文件頁數(shù)： | 29/96頁 |
| 文件大?。?/td> | 1607K |
| 代理商： | QL8150-8PTN280I |
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2007 QuickLogic Corporation
Eclipse II Family Data Sheet Rev. Q
35
NOTE: When using a PLL, t
PGCK and tBGCK are effectively zero due to delay adjustment by Phase Locked
Loop feedback path.
Figure 35: Global Clock Structure Timing Elements
Figure 36: Dual-Port SRAM Cell
Table 21: Eclipse II Tree Clock Delay
Clock Segment
Parameter
Value
Min
Max
t
PGCK
Global clock pin delay to quad net
-
1.92 ns
t
BGCK
Global clock tree delay (quad net to flip-flop)
-
0.28 ns
t
DPD
Dedicated clock pad
-
1.7 ns
t
GSKEW
Global delay clock skew
-
0.1 ns
t
DSKEW
Dedicated clock skew
-
0.05 ns
Internally generated clock, or
clock from general routing network
Global Clock
(CLK) Input
Quad-Net Clock Network
FF
Global Clock Buffer
WA
WD
WE
WCLK
RE
RCLK
RA
RD
RAM Module
[7:0]
[17:0]
[7:0]
[17:0]
ASYNCRD
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| QL8150-8PTN280M | FPGA, 640 CLBS, 188946 GATES, PBGA280 |
| QL8150-8PUN196C | FPGA, 640 CLBS, 188946 GATES, PBGA196 |
| QL8150-8PUN196I | FPGA, 640 CLBS, 188946 GATES, PBGA196 |
| QL8150-8PUN196M | FPGA, 640 CLBS, 188946 GATES, PBGA196 |
| QLL12X16B-0CG84C | FPGA, 192 CLBS, 2000 GATES, 80 MHz, CPGA84 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| QL8250 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:LOW POWER FPGA COMBINING PERFORMANCE DENSITY AND EMBEDED RAM |
| QL8250-6PQN208C-5690 | 制造商:QuickLogic Corporation 功能描述: |
| QL8250-6PQN208C-5691 | 制造商:QuickLogic Corporation 功能描述: |
| QL82SD | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:10 High Speed Bus LVDS Serial Links bandwidth up to 5 Gbps |
| QL82SD-PB516 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:10 High Speed Bus LVDS Serial Links bandwidth up to 5 Gbps |
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