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參數(shù)資料
| 型號： | QL8150-7PFN144M |
| 廠商： | QUICKLOGIC CORP |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 640 CLBS, 188946 GATES, PQFP144 |
| 封裝： | LEAD FREE, TQFP-144 |
| 文件頁數(shù)： | 30/96頁 |
| 文件大?。?/td> | 1607K |
| 代理商： | QL8150-7PFN144M |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁當(dāng)前第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁
2007 QuickLogic Corporation
Eclipse II Family Data Sheet Rev. Q
36
Figure 37: RAM Cell Synchronous Write Timing
Table 22: RAM Cell Synchronous Write Timing
Symbol
Parameter
Value
Min
Max
RAM Cell Synchronous Write Timing
tSWA
WA setup time to WCLK: time the WRITE ADDRESS must be stable before the
active edge of the WRITE CLOCK
0.47 ns
-
t
HWA
WA hold time to WCLK: time the WRITE ADDRESS must be stable after the
active edge of the WRITE CLOCK
0 ns
-
tSWD
WD setup time to WCLK: time the WRITE DATA must be stable before the active
edge of the WRITE CLOCK
0.48 ns
-
tHWD
WD hold time to WCLK: time the WRITE DATA must be stable after the active
edge of the WRITE CLOCK
0 ns
-
t
SWE
WE setup time to WCLK: time the WRITE ENABLE must be stable before the
active edge of the WRITE CLOCK
0 ns
-
tHWE
WE hold time to WCLK: time the WRITE ENABLE must be stable after the active
edge of the WRITE CLOCK
0 ns
-
tWCRD
WCLK to RD (WA = RA): time between the active WRITE CLOCK edge and the
time when the data is available at RD
-
3.79 ns
tSWA
tSWD
tSWE
tHWA
tHWD
tHWE
tWCRD
old data
new data
WCLK
WA
WD
WE
RD
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| QL8150-8PFN144C | FPGA, 640 CLBS, 188946 GATES, PQFP144 |
| QL8150-8PFN144I | FPGA, 640 CLBS, 188946 GATES, PQFP144 |
| QL8150-8PTN196M | FPGA, 640 CLBS, 188946 GATES, PBGA196 |
| QL8150-7PTN196C | FPGA, 640 CLBS, 188946 GATES, PBGA196 |
| QL8150-7PTN196M | FPGA, 640 CLBS, 188946 GATES, PBGA196 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| QL8250 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:LOW POWER FPGA COMBINING PERFORMANCE DENSITY AND EMBEDED RAM |
| QL8250-6PQN208C-5690 | 制造商:QuickLogic Corporation 功能描述: |
| QL8250-6PQN208C-5691 | 制造商:QuickLogic Corporation 功能描述: |
| QL82SD | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:10 High Speed Bus LVDS Serial Links bandwidth up to 5 Gbps |
| QL82SD-PB516 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:10 High Speed Bus LVDS Serial Links bandwidth up to 5 Gbps |
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