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參數(shù)資料
| 型號： | QL8150-6PTN196I |
| 廠商： | QUICKLOGIC CORP |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 640 CLBS, 188946 GATES, PBGA196 |
| 封裝： | 0.80 MM PITCH, LEAD FREE, TFBGA-196 |
| 文件頁數(shù)： | 56/96頁 |
| 文件大?。?/td> | 1607K |
| 代理商： | QL8150-6PTN196I |
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2007 QuickLogic Corporation
Eclipse II Family Data Sheet Rev. Q
6
Figure 5: ECU Block Diagram
The Eclipse II ECU blocks (Table 4) are placed next to the SRAM circuitry for efficient memory/instruction
fetch and addressing for DSP algorithmic implementations.
Up to twelve 8-bit MAC functions can be implemented per cycle for a total of 1 billion MACs/s when clocked
at 100 MHz. Additional multiply-accumulate functions can be implemented in the programmable logic.
The modes for the ECU block are dynamically re-programmable through the programmable logic.
Table 4: Eclipse II ECU Blocks
Device
ECUs
QL8325
12
QL8250
10
QL8150
0
QL8050
0
QL8025
0
A[0:15]
B[0:15]
SIGN2
SIGN1
CIN
S1
S2
S3
A
B
C
D
3-4
decoder
8-bit
Multiplier
16-bit
Adder
17-bit
Register
2-1
mux
2-1
mux
3-1
mux
Q[16:0]
CLK
RESET
DQ
00
01
10
A[7:0]
A[15:8]
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| QL8150-8PQN208M | FPGA, 640 CLBS, 188946 GATES, PQFP208 |
| QL8150-6PQN208C | FPGA, 640 CLBS, 188946 GATES, PQFP208 |
| QL8150-6PQN208I | FPGA, 640 CLBS, 188946 GATES, PQFP208 |
| QL8150-7PQN208C | FPGA, 640 CLBS, 188946 GATES, PQFP208 |
| QL8150-7PQN208I | FPGA, 640 CLBS, 188946 GATES, PQFP208 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| QL8250 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:LOW POWER FPGA COMBINING PERFORMANCE DENSITY AND EMBEDED RAM |
| QL8250-6PQN208C-5690 | 制造商:QuickLogic Corporation 功能描述: |
| QL8250-6PQN208C-5691 | 制造商:QuickLogic Corporation 功能描述: |
| QL82SD | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:10 High Speed Bus LVDS Serial Links bandwidth up to 5 Gbps |
| QL82SD-PB516 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:10 High Speed Bus LVDS Serial Links bandwidth up to 5 Gbps |
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