參數(shù)資料
型號: PT7M7452TTAE
廠商: PERICOM SEMICONDUCTOR CORP
元件分類: 電源管理
英文描述: 1-CHANNEL POWER SUPPLY SUPPORT CKT, PDSO6
封裝: LEAD FREE, MO-178AB, SOT-23, 6 PIN
文件頁數(shù): 10/11頁
文件大?。?/td> 542K
代理商: PT7M7452TTAE
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PT0289(07/07)
Ver: 0
8
Preliminary Data Sheet
PT7M7443-52
P Supervisory Circuit
-- Continued --
(VDD =1.0 to 5.5V, TA= -40~85℃, unless otherwise specified. Typical values are at TA = +25℃) (Note 1)
Parameter
Symbol
Test Conditions
Min
Typ
Max
Unit
VDD to /RESET Output Delay
tRD
VDD falling at 1mV/us
-
20
-
us
/MR1 Minimum Setup Period
Pulse Width
tMR
-
4.48
6.72
8.96
s
/MR1+/MR2 Minimum Setup
Period Pulse Width
-
PT7M7445/7446/7449/7450
4.48
6.72
8.96
s
MR2 Minimum Setup Period
Pulse Width
-
PT7M7447/7448/7451/7452
1
-
us
MR2 Glitch Rejection
-
PT7M7447/7448/7451/7452
-
100
-
ns
MR2 to /RESET Delay
-
PT7M7447/7448/7451/7452
-
200
-
ns
Manual Reset Timeout Period
tMRP
-
140
210
280
ms
/MR1 to VDD Pull-up
Impedance
-
25
50
75
k
/MR2 to VDD Pull-up
Impedance
-
PT7M7445/7446/7449/7450
25
50
75
k
VDD ≥ 1.00V, ISINK=50uA, /RESET
asserted
-
0.3
VDD ≥ 1.20V, ISINK=100uA, /RESET
asserted
-
0.3
VDD ≥ 2.55V, ISINK=1.2mA, /RESET
asserted
-
0.3
/RESET Output Low
(Open-Drain or Push-Pull)
VOL
VDD ≥ 4.25V, ISINK=3.2mA, /RESET
asserted
-
0.4
V
VDD ≥ 1.80V, ISOURCE=200uA, /RESET
deasserted
0.8×VD
D
-
VDD ≥ 3.15V, ISOURCE=500uA, /RESET
deasserted
0.8×VD
D
-
/RESET Output High
(Push-Pull)
VOH
VDD ≥ 4.75V, ISOURCE=800uA, /RESET
deasserted
0.8×VD
D
-
V
/RESET Open-Drain Leakage
Current
ILKG
/RESET deasserted
-
1
uA
/MR1, /MR2, MR2 Input Low
Voltage
VIL
-
0.3×V
DD
V
/MR1, /MR2, MR2 Input
High Voltage
VIH
-
0.7×VD
D
-
V
Note 1: Devices production tested at +25℃. Overtemperature limits are guaranteed by design.
相關(guān)PDF資料
PDF描述
PT7M7445MTAE 1-CHANNEL POWER SUPPLY SUPPORT CKT, PDSO5
PT7M7444TTAE 1-CHANNEL POWER SUPPLY SUPPORT CKT, PDSO5
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PT7M7451VTAE 1-CHANNEL POWER SUPPLY SUPPORT CKT, PDSO6
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參數(shù)描述
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