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參數(shù)資料
| 型號： | PT7M7448ZTAE |
| 廠商： | PERICOM SEMICONDUCTOR CORP |
| 元件分類： | 電源管理 |
| 英文描述： | 1-CHANNEL POWER SUPPLY SUPPORT CKT, PDSO5 |
| 封裝： | LEAD FREE, MO-178AA, SOT-23, 5 PIN |
| 文件頁數(shù)： | 5/11頁 |
| 文件大小： | 542K |
| 代理商： | PT7M7448ZTAE |
|
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PT0289(07/07)
Ver: 0
3
Preliminary Data Sheet
PT7M7443-52
P Supervisory Circuit
Pin Configuration
Pin Description
Pin
7443/44
7445/46
7447/48
7449/50
7451/52
Name
Function
1
2
GND
Ground
3
1
/RESET
Active-Low
Push-Pull
or
Open-Drain
Output.
/RESET changes from high to low when VDD or RSTIN
drops below its selected reset threshold and remains low
for the 210ms reset timeout period after all monitored
power-supply inputs exceed their selected reset
thresholds. /RESET is one-shot pulsed low for the reset
timeout period (140ms min) after selected manual reset
inputs are asserted longer than the specified setup period.
For the open-drain output, use a minimum 20k pull-up
resistor to VDD.
4
--
3
--
3
Manual Reset Input, Active Low. Internal 50k pull-
up to VDD. Pull /MR1 low for the typical input pulse
width (6.72s) to one-shot pulse /RESET for the reset
timeout period.
--
3
--
3
--
/MR1
Manual Reset Input, Active Low. Pull both /MR1 and
/MR2 low for the typical input pulse width (6.72s) to
one-shot pulse /RESET for the reset timeout period.
5
4
VDD
VDD Voltage Input. Power supply and input for the
primary microprocessor voltage reset monitor.
--
5
--
6
--
/MR2
Manual Reset Input, Active Low. Internal 50k pull-
up to VDD. Pull both /MR1 and /MR2 low for the typical
input pulse width (6.72s) to one-shot pulse /RESET for
the reset timeout period.
--
5
--
6
MR2
Manual Reset Input. Pull theMR2 high to immediately
one-shot pulse /RESET for the reset timeout peiod.
--
5
RSTIN
Reset Input. High-impedance input to the adjustable
reset comparator. Connect RSTIN to the center point of
an external resistor-divider to set the threshold of the
externally monitored voltage.
2
--
NC
Not Connected.
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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