參數(shù)資料
型號： PSP410
英文描述： -200V Single P-Channel Hi-Rel MOSFET in a TO-254AA package; A IRFM9240 with Standard Packaging
中文描述： 模擬IC
文件頁數(shù)： 157/317頁
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代理商： PSP410
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PSB 2115
PSF 2115
Operational Description
Semiconductor Group
157
11.97
General IPAC registers
The IPAC registers for general functions are located in the address range C0h - CCh.
The reset values are summarized in
table 18
.
Table 19
Register
RESET Values for General IPAC Registers
Value after
Reset (hex)
00
– transformer ratio 2:1
– Test mode disabled
– D-Channel priority handler disabled
– Pin AUX7 is general I/O
– DU/DD are open drain
– IOM is operational
00
– No interrupts
C0
– INT0/1 masked
– All other interrupts enabled
00
– AUX2-7 are open drain (as outputs)
– INT0,1 are negative level triggered (as INT inputs)
FC
– AUX2-7 are inputs
00
– Output value for AUX2-7 is 0
00
– PCMIN line is disabled
– RX data from PCMIN mapped to DU line
– Selected PCM timeslot is channel 0
00
– PCMOUT line is disabled
– TX data on PCMOUT derived from DD line
– Selected PCM timeslot is channel 0
00
– ACL will indicate S-bus activation status
– AUX3-5 are used for PCM interface (LT modes)
– FSC (derived from DCL in) is output
on AUX3 (LT modes)
– IOM Channel 0 selected for PCM interface
(LT modes)
00
– 8 bit timeslot length
– SDS active during timeslot 0
00
– Count down timer mode
– Timer is disabled
Meaning
CONF
ISTA
MASK
ACFG
AOE
ATX
PITA1/2
POTA1/2
PCFG
SCFG
TIMR2
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PDF描述
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